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第五章时序电路
一、选择题
1．同步计数器和异步计数器比较，同步计数器的显著优点是。
A.工作速度高B.触发器利用率高C.电路简单D.不受时钟CP控制。
2．把一个五进制计数器与一个四进制计数器串联可得到进制计数器。
3．下列逻辑电路中为时序逻辑电路的是。
A.变量译码器B.加法器C.数码寄存器D.数据选择器
4.N个触发器可以构成最大计数长度（进制数）为的计数器。
5.N个触发器可以构成能寄存位二进制数码的寄存器。
+1
6．五个D触发器构成环形计数器，其计数长度为。
7．同步时序电路和异步时序电路比较，其差异在于后者。
A.没有触发器B.没有统一的时钟脉冲控制
C.没有稳定状态D.输出只与内部状态有关
8．一位8421BCD码计数器至少需要个触发器。
9.欲设计0，1，2，3，4，5，6，7这几个数的计数器，如果设计合理，采用同
步二进制计数器，最少应使用级触发器。
10．8位移位寄存器，串行输入时经个脉冲后，8位数码全部移入寄存器中。
11．用二进制异步计数器从0做加法，计到十进制数178，则最少需要个
触发器。
12．某电视机水平-垂直扫描发生器需要一个分频器将31500H的脉冲转换为60H
ZZ
的脉冲，欲构成此分频器至少需要个触发器。
13．某移位寄存器的时钟脉冲频率为100KH，欲将存放在该寄存器中的数左移8
Z
位，完成该操作需要时间。
μSμSμS
n1n
14.若用JK触发器来实现特性方程为QAQAB，则JK端的方程为。
=AB，K=AB=AB，K=AB=AB，K=AB=AB，K=AB
15．要产生10个顺序脉冲，若用四位双向移位寄存器CT74LS194来实现，需要片。
16．若要设计一个脉冲序列为10的序列脉冲发生器，应选用个触发器。
二、判断题（正确打√，错误的打×）
1．同步时序电路
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