阵列除法器_原创精品文档.pdfVIP

  1. 1、本文档共20页,可阅读全部内容。
  2. 2、原创力文档(book118)网站文档一经付费(服务费),不意味着购买了该文档的版权,仅供个人/单位学习、研究之用,不得用于商业用途,未经授权,严禁复制、发行、汇编、翻译或者网络传播等,侵权必究。
  3. 3、本站所有内容均由合作方或网友上传,本站不对文档的完整性、权威性及其观点立场正确性做任何保证或承诺!文档内容仅供研究参考,付费前请自行鉴别。如您付费,意味着您自己接受本站规则且自行承担风险,本站不退款、不进行额外附加服务;查看《如何避免下载的几个坑》。如果您已付费下载过本站文档,您可以点击 这里二次下载
  4. 4、如文档侵犯商业秘密、侵犯著作权、侵犯人身权等,请点击“版权申诉”(推荐),也可以打举报电话:400-050-0827(电话支持时间:9:00-18:30)。
  5. 5、该文档为VIP文档,如果想要下载,成为VIP会员后,下载免费。
  6. 6、成为VIP后,下载本文档将扣除1次下载权益。下载后,不支持退款、换文档。如有疑问请联系我们
  7. 7、成为VIP后,您将拥有八大权益,权益包括:VIP文档下载权益、阅读免打扰、文档格式转换、高级专利检索、专属身份标志、高级客服、多端互通、版权登记。
  8. 8、VIP文档为合作方或网友上传,每下载1次, 网站将根据用户上传文档的质量评分、类型等,对文档贡献者给予高额补贴、流量扶持。如果你也想贡献VIP文档。上传文档
查看更多

课程设计报告

课程设计名称:计算机组成原理课程设计

课程设计题目:阵列除法器的设计

院(系):

专业:

班级:

学号:

姓名:

指导教师:

完成日期:

目录

第1章总体设计方案

1.1设计原理

1.2设计思路.

1.3设计环境

第2章详细设计方案

2.1顶层方案图的设计与实现

2.1.1创建顶层图形设计文件

2.1.2器件的选择与引脚锁定

2.1.3编译、综合、适配

2.2功能模块的设计与实现

2.3仿真调试

第3章编程下载与硬件测试

3.1编程下载

3.2硬件测试及结果分析

参考文献

附录(电路原理图)

I

--

第1章总体设计方案

1.1设计原理

阵列除法器的功能是利用一个可控加法/减法(CAS)单元所组成的流水阵列

来实现的。它有四个输出端和四个输入端。当输入线P=0时,CAS作加法运算;

当P=1时,CAS作减法运算。可控加法/减法(CAS)单元的逻辑电路图如图1.1

所示。

图1.1可控加法/减法(CAS)单元的逻辑图

CAS单元的输入与输出关系可用如下一组逻辑方程来表示:

S=A⊕(B⊕P)⨁C

iii

C=(A+C)∙(B⊕P)+AC

i+1iiiii

当P=0时,就得到我们熟悉的一位全加器(FA)的公式:

S=A⊕B⊕C

iiii

C=AB+BC+AC

i+1iiiiii

当P=1时,则得求差公式:

S=A⨁B⨁C

iiii

C=AB+BC+AC

i+1iiiiii

其中B=B⨁1。

ii

在减法情况下,输入C称为借位输入,而C称为借位输出。

ii+1

1

文档评论(0)

150****0174 + 关注
实名认证
文档贡献者

该用户很懒,什么也没介绍

1亿VIP精品文档

相关文档