电工与电子技术门电路与组合逻辑电路.pptVIP

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2025-09-30 发布于广东
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电工与电子技术门电路与组合逻辑电路.ppt

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T5YR3R5ABCR4R2R1T3T4T2+5VT1(1)输入全为高电平“1”(3.6V)时2.工作原理4.3VT2、T5饱和导通钳位2.1VE结反偏截止“0”(0.3V)负载电流（灌电流）输入全高“1”,输出为低“0”1VT1R1+UccT4第29页，共72页，星期日，2025年，2月5日T5YR3R5ABCR4R2R1T3T4T2+5VT12.工作原理1VT2、T5截止负载电流（拉电流）(2)输入端有任一低电平“0”(0.3V)(0.3V)“1”“0”输入有低“0”输出为高“1”流过E结的电流为正向电流5VVY?5-0.7-0.7=3.6V第30页，共72页，星期日，2025年，2月5日有“0”出“1”全“1”出“0”“与非”逻辑关系00010011101111011001011101011110ABYC“与非”门逻辑状态表Y=ABC逻辑表达式：YABC“与非”门第31页，共72页，星期日，2025年，2月5日74LS00、74LS20管脚排列示意图1211109814133456712UCC4B4A4Y3B3A3Y1B1A1Y2B2A2YGND(a)74LS001211109814133456712UCC2D3C2BNC2A2Y1B1ANC1D1C1YGND74LS20(b)第32页，共72页，星期日，2025年，2月5日(1)电压传输特性：输出电压UO与输入电压Ui的关系。CDE3.TTL“与非”门特性及参数电压传输特性测试电路ABO1231234Ui/VUO/V+5VUiUoVV第33页，共72页，星期日，2025年，2月5日ABCDE(2)TTL“与非”门的参数电压传输特性典型值3.6V，?2.4V为合格典型值0.3V，?0.4V为合格输出高电平电压UOH输出低电平电压UOL输出高电平电压UOH和输出低电平电压UOLUO/VO1231234Ui/V第34页，共72页，星期日，2025年，2月5日平均传输延迟时间tpd50%50%tpd1tpd2TTL的tpd约在10ns~40ns，此值愈小愈好。输入波形ui输出波形uO第35页，共72页，星期日，2025年，2月5日扇出系数输入高电平电流IIH和输入低电平电流IIL低电平噪声容限电压:保证输出高电平电压不低于额定值90%的条件下所允许叠加在输入低电平电压上的最大噪声（或干扰）电压。高电平噪声容限电压:保证输出低电平电压的条件下所允许叠加在输入高电平电压上的最大噪声（或干扰）电压。第36页，共72页，星期日，2025年，2月5日YEBA逻辑符号??0高阻0011011110111110?表示任意态三态输出“与非”门三态输出“与非”状态表ABEY功能表输出高阻电路分析时高阻态可做开路理解第37页，共72页，星期日，2025年，2月5日三态门应用：可实现用一条总线分时传送几个不同的数据或控制信号。“1”“0”“0”如图所示：总线A1B1E1A2B2E2A3B3E3A1B1第38页，共72页，星期日，2025年，2月5日CMOS非门电路AYT2+UDDT1N沟道P沟道GGDSS20.4CMOS门电路PMOS管NMOS管CMOS管负载管驱动管(互补对称管)A=“1”时，T1导通，T2截止，Y=“0”A=“0”时，T1截止，T2导通，Y=“1”Y=A第39页，共72页，星期日，2025年，2月5日T4与T3并联，T1与T2串联；当AB都是高电平时,T1与T2同时导通，T4与T3同时截止；输出Y为低电平。