数字系统设计期中试卷2011-2012学年第二学期.pdfVIP

数字系统设计期中试卷2011-2012学年第二学期.pdf

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2011年~2012年第2学期

课程名称:数字系统设计专业年级:

考生学号:考生:

试卷类型:A卷▋B卷□考试方式:开卷□闭卷▋

………………………

一、填空(每空1分,共15分)

1.F是一个含4个变量A、B、C、D逻辑函数,则它的编号为9的最小项m9=;

编号为9的最大项M9=。

2.十进制数87和(-87)的8位二进制补码形式分别为和。

3.在VHDL程序中,判断CLK引脚是否出现下降沿的条件表达式为。

4.组合逻辑电路任意时刻的输出只与该时刻的有关,而与电路的原状态无关。

5.组合逻辑电路中,的功能是用来将一路数据分时传输到多路通道中去。

6.VHDL语言程序可以由5部分组成,其中和是必不可少的两部分。

7.最小项表达式又称为式;最大项表达式又称为式。

8.两个变量的反演律为和。

9.n个逻辑变量进行异或,如果其中有奇数个“1”,则异或的结果是。

10.VHDL的4种数据对象中,用来将实体与实体、元件与元件连接起来构成系

统。

二、单项选择题(每小题1分,共10分)

1.下面的编码中,()是正确的2位循环码的顺序。

A.00、01、10、11B.00、10、01、11

C.00、01、11、10D.00、11、10、01

2.将十六进制的数据0.1H转换为十进制数为()。

A.0.1B.0.5C.0.0625D.0.125

3.具有5个变量的逻辑函数具有()个最大项。

A.5B.10C.32D.15

4.同一个十进制数字的余3码比它的8421码()。

A.多0110B.少0110C.少0011D.多0011

5.下面列出的选项中,()不是消除竞争-的方法。

A.修改逻辑设计B.接入滤波电容C.引入选通脉冲D.进行时序仿真

6.在多种数据编码方式中,()能将减法转换为加法。

A.补码B.原码C.反码D.机器码

7.16位二进制编码能够表示的十进制无符号数的范围是()。

A.0∼B.0∼127C.0∼+255D.0∼

8.在利用卡诺图对逻辑函数进行化简时,每个卡诺圈中填“1”的小方格的个数应满足(

2011~2012semester2

Coursename:DigitalsystemdesignP

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