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7SeriesFPGAsIntegratedBlockfor核中基于64 位事务层接口的AXI4-Stream 接口设计.pdf

7SeriesFPGAsIntegratedBlockfor核中基于64 位事务层接口的AXI4-Stream 接口设计.pdf

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    7SeriesFPGAsIntegratedBlockfor

    PCIExpressIP核中基于64位事务层接口

    的AXI4-Stream接口设计

    基于64位事务层接口的AXI4-Stream接口设计主要涉及信号定义、数据传输规则以及

    接口行为等方面。

    一、TLP格式

    数据在AXI4-Stream接口上以Big-Endian顺序进行传输和接收，这是遵循PCIExpress

    基本规范[Ref2]的要求。Big-Endian是一种数据表示方式，其中高位字节存储在内存

    的低地址处，低位字节存储在内存的高地址

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