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MajorChipsets
2.1M1531
M1531includesthehigherCPUbusfrequency(upto83.3MHz)interfacefortheincomingCyrixM2
andAMDK6,PBSRAMandMemoryCacheL2controller,internalMESItagbits(8K*2)toreducecost
andenhanceperformance,highperformanceFPM/EDO/SDRAMDRAMcontroller,PCI2.1compliant
businterface,smartdeepbufferdesignforCPU-to-DRAM,CPU-to-PCI,andPCI-to-DRAMtoachieve
thebestsystemperformance,andalsothehighlyefficientPCIfairarbiter.M1531alsoprovidesthe
mostflexible32/64-bitmemorybusinterfaceforthebestDRAMupgradeabilityandECC/Parity
designtoenhancethesystemreliability.
Withtheconcurrentbusdesign,PCI-to-PCIaccesscanrunconcurrentlywithCPU-to-L2andCPU-
to-DRAMaccess,PCI-to-DRAMaccesscanrunconcurrentlywithCPU-to-L2access.M1531also
supportsthesnoopaheadfeaturetoachievethePCImasterfullbandwidthaccess(133Mbytes).
M1531alsoprovidestheenhancedpowermanagementfeaturesincludingACPIsupport,suspend
DRAMrefresh,andinternalchippowercontroltosupportthe’sOnNowtechnologyOS.
2.1.1Features
•SupportsallIntel/Cyrix/AMD/TI/586processors.Hostbusat83.3,75,66,60and50MHz
at3.3V/2.5V
•SupportsLinearWrapmodeforCyrixM1andM2
Write-AllocationfeatureforK6
Pseudo-synchronousPCIbusaccess
(CPUbus:75MHz-PCIbus:30MHz,CPUbus:83.3MHz-PCIbus:33MHz)
•SupportsPipelined-burstSRAM/MemoryCache
Directmapped,256KB/512KB/1MB
Write-Back/Dynamic-Write-Backcache
Built-in8Kx2bitSRAMforMESIprotocoltoreducecostandenhanceperformance
Cacheablememoryupto64MBwith8-bitTagSRAM
Cacheablem
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