DSlogos2系列器件数据手册修订记录.pdfVIP

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修订记录

期修订版本述

2019.9.9V0.1初始Alphab版本发布

增加热插性说明,支持热插级

2019.10.21V0.2

表5‑1LVDS性能参数改为TBD

1.修改表2‑1和表2‑2的V信号说明;

2019.12.6V0.3IN

2.修改表7‑7HSSTLP的时钟接口速率说明

1.修改Logos2系列FPGA产品概述及特性描述;

2.修改表1‑1,表1‑2增加SERDESLANE说明;

2020.4.2V1.03.更新图1‑1说明;

4.删除3.1上电顺序中的VCCA_IO

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