勇敢的芯伴你玩转Altera-FPGA连载30：可综合的语法子集1.docx

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勇敢的芯伴你玩转AlteraFPGA连载30：可综合的语法子集1

所谓可综合的语法，是指硬件能够实现的一些语法，这些语法能够被工具所支持，能够通过编译终于生成用于烧录到FPGA器件中的配置数据流。无论是语言还是语言，可综合的子集都很小。但是如何用好这些语法，什么样的代码风格更适合于硬件实现，是每一位初学者都需要下功夫好好把握的。下面是常用的RTL级的Verilog语法及其容易的使用描述。Verilog和的语法上的确有无数相像相通之处，学习语法时互相类比举行记忆也未尝不行，但是笔者不安一旦过多的混淆C语言和Verilog，