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课
程
报
告
学部： 信息与科学技术
专业：
学号：
姓名：
报告目录
1.目录.......................................1
2.实验目的....................................2
3.实验内容....................................2
4. 60进制计数器................................3
5. 24进制计器.................................4
6. 连接............................. ......6
7.实验总结......................................8
实验目的:
实现多功能数字钟的设计
利用quartus II 9.1设计一个多功能数字钟，使之实现计时功能，并且熟练的操作本软件。
多功能时钟主要是通过制作24进制与60进制的计数器，将其连接起来从而实现时钟功能 。
其基本功能如下：时钟计数器为24进制，即0-23；
分钟与秒钟计数器为60进制，即0-59；
时钟与分钟、秒钟连接实现计时功能；
二．实验内容：
基本内容：
利用软件画出60进制与24进制的电路图，并且通过编译及波形仿真，再打包建立成模块。
通过软件再与所形成模块实现连接，从而形成时钟电路。
扩展内容：
1.定时闹钟
2.仿电台报时
3.报整点时数
数字钟电路系统的组成框图
1.60进制计数器的设计
a.用软件按照教材P119所示绘制60进制电路图，即如下图所示：
b．如图绘制完成后再进行编译和波形仿真，仿真的步骤如软件说明所示，经过仿真所得到的波形仿真图形如图所示：
c.经仿真无误，能实现60进制的功能变化时，在图形输入界面，即电路原理图所示的页面，进行打包工作，将60进制的图形建立成模块如图所示：
2. 24进制计数器的设计
a.在图形输入界面中如60进制画出电路图，如下所示：
b．如图绘制完成后再进行编译和波形仿真，仿真的步骤如软件说明所示，经过仿真所得到的波形仿真图形如图所示：
c.经仿真无误，能实现24进制的功能变化时，在图形输入界面，即电路原理图所示的页面，进行打包工作，将24进制的图形建立成模块如图所示：
3、将24进制与60进制的模块相连
a．将一个24进制与二个60进制的模块如下图所示连接：
b.将以连接好的电路进行编译并进行波形仿真，如下图所示：
c.将电路图进行打包，得到如下模块：
实验总结：
本次实验中使我熟练的运用啦本软件，对其仿真功能有了深入的认识，在同学的帮助下我才完成本次实验，而扩展实验则还没有做好，所以本软件的运用还有待提高。
本次实验也让我认识到啦数字时钟的工作原理，它是运用计数器原理进行运行的，通过软件编译进行译码。说实话本次实验感觉失败的，因为没有完成好本次实验的内容，但是得到了很多收获，特别是本次软件的操作及数字时钟的工作原理等等。
在本次设计中遇到了很多困难，例如书中的电路为什么这样设计，都只知道按教材中所给的电路进行连接，根本没有思考这方的问题，所以在原理上面还有很多值得我们沉思的问题，基本原理方面的知识还有待提高。
1
秒译码显示
分译码显示
时译码显示
60进制分计数器
60进制秒计数器
24进制小时计数器
仿电台报时
分频器
校时电路
定时闹钟
主体电路
扩展电路
振荡器
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