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2011第2章 VHDL硬件描述语言.ppt
类似一个“黑匣子”,实体描述了“黑匣子”的输入、输出口。 1、实体结构 2 输入与门的实体: ENTITY and_gate IS GENERIC (delay:time) PORT(a,b:IN BIT; y:OUT BIT); END and_gate; 2、类属参量(Generic)说明 ENTITY and_gate IS GENERIC (delay:time) PORT(a,b:IN BIT; y:OUT BIT); END and_gate; 2、类属参量(Generic)说明 类属参量 一种端口界面常数,用来规定端口的宽度、器件的延迟时间等参数,类属的值可从设计实体外部提供。 数据类型通常取Integer或Time。 综合器仅支持数据类型为整数的类属值。 与常数不同 常数只能从内部赋值而类属参量可以由实体外部赋值。 2、类属参量(Generic)说明 类属参量说明格式 例2:N位加法器实体 entity adder_n is generic(width : integer := 4); port( A: in STD_LOGIC_VECTOR(width-1 downto 0); B: in STD_LOGIC_VECTOR(width-1 downto 0); S: out STD_LOGIC_VECTOR(width-1 downto 0); CI: in STD_LOGIC; CO: out STD_LOGIC ); end adder_n; 3、端口(PORT)说明 端口(PORT)是实体的一部分 PORT 类似于器件的管脚,主要用于信号的传输; PORT 一般有 Name, Mode, 和 Type。 端口说明格式 PORT ([SIGNAL] Name1:Mode Type [BUS]; [SIGNAL] Name2:Mode Type [BUS]; … … ); 端口类型 IN:(单向) 数据只能从端口流入实体 OUT :(单向) 数据只能从端口流出实体 INOUT:(双向) 数据从端口流入或流出实体 BUFFER: (可反馈) 数据从端口流出实体,同时 可被内部反馈 LIBRARY ieee; USE ieee.std_logic_1164.ALL; ENTITY my_design IS PORT ( d: IN std_logic_vector(11 DOWNTO 0); oe, clk: IN std_logic; ad: INOUT std_logic_vector(11 DOWNTO 0); a: OUT std_logic_vector(11 DOWNTO 0); int: OUT std_logic; as: BUFFER std_logic); END my_design; 用来存储预先完成的程序包和数据集合体的仓库 在VHDL设计中若使用库中内容,必须在该设计的实体前使用库语句和USE语句 语句格式: LIBRARY 库名; USE 库名.程序包名. All; 主要用来存放各个设计都能共享的数据类型、子程序说明、属性说明和元件说明等部分。 使用包时可以用USE语句说明,例如: USE IEEE.STD_LOGIC_1164.ALL 程序包分为包头和包体,格式如下: (1)包头格式: ? PACKAGE 包名 IS [说明语句] END 包名 (2)包体格式: PACKAGE BODY 包名 IS [说明语句] END 包名; 例:定义一个4位长常数零和一个8位长常数零。 Consta
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