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基于FPGA的嵌入式PLC微处理器设计 　　摘要：目前利用FPGA设计高性能的嵌入式处理器已经成为SOC设计的重要部分，对一种基于FPGA芯片的嵌入式PLC处理器进行了研究和设计，并采用了基于VHDL语言的自顶向下的模块化设计方法，顶层设计使用原理图输入。最后用QuartusII进行仿真，给出了主要仿真结果。实验表明，该处理器能准确且快速的响应嵌入式PLC的逻辑指令，且较传统的PLC处理器更灵活，集成度更高。 　　0 前言 　　现场可编程门阵列(FPGA)是近几年来出现并被广泛应用的大规模集成电路器件，它的特点是直接面向用户，具有极大的灵活性和通用性使用方便，硬件测试和实现快捷，开发效率高，成本低，上市时间短，技术维护简单，工作可靠性好等。 　　硬件描述语言(VHDL)是用来描述硬件电路的功能，信号连接关系及时序关系的高级硬件编程语言，设计者可根据VHDL语言法则，对系统的逻辑进行行为描述，然后通过综合工具进行电路结构的综合、编译、优化，用仿真工具进行逻辑功能仿真和系统时序仿真，可在短时间内设计出高效、稳定、符合设计要求的大规模或超大规模的集成电路。 　　该处理器采用了TOP—DOWN的层次网络模块化设计方法，用VHDL描述了嵌入式PLC的CPU的主要逻辑功能，考虑到嵌入式CPU结构的复杂性和设计的可扩展性，在顶层设计中采用了原理图的方法，通过VHDL对每个单元模块进行了仿真和综合