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2位BCD码加法器设计
2位BCD码加法器设计
源程序
module adder(A0,A1,B0,B1,a0,a1,b0,b1,s0,s1,s2); //模块名为adder和端口列表
input[3:0]A0,A1,B0,B1;//定义模块的输入端口，分别表示数A的个位、十位，数B的个位、十位。
output[6:0]a0,a1,b0,b1,s0,s1,s2;//定义模块的输出端口，分别表示数码管输出的加数，被加数，和的各位。
reg[6:0]a0,a1,b0,b1,s0,s1,s2;
reg[4:0]T0,T1;
reg[3:0]Z0,Z1;
reg c1,c2,S2;//定义S2为和的百位，其他均为中间变量。
reg[3:0]S0,S1;//定义S0为和的个位。S1为和的百位。
always
begin
T0 = A0 + B0;
if(T0 9)//判断十位是否有进位，有则c1=1，没有c1=0。
begin
Z0 = 10;
c1 = 1;
end
else
begin
Z0 = 0;
c1 = 0;
end
S0 = T0-Z0;//和个位的算法。
T1 = A1 + B1 + c1;
if (T1 9)//判断百位是否有进位，有则c2=1，没有c2=0。
begin
Z1 = 10;
c2 = 1;
end
else
begin
Z1 = 0;
c2 = 0;
end
S1 = T1-Z1;//和十位的算法。
S2 = c2;//和百位的算法。
End
//利用case语句分别让数码管显示加数，被加数，和的各位。
always @(A0)
begin
case(A0)
4d0:a0=7b0000001;
4d1:a0=7b1001111;
4d2:a0=7b0010010;
4d3:a0=7b0000110;
4d4:a0=7b1001100;
4d5:a0=7b0100100;
4d6:a0=7b0100000;
4d7:a0=7b0001111;
4d8:a0=7b0000000;
4d9:a0=7b0000100;
default: a0=7bx;
endcase
end
always @(A1)
begin
case(A1)
4d0:a1=7b0000001;
4d1:a1=7b1001111;
4d2:a1=7b0010010;
4d3:a1=7b0000110;
4d4:a1=7b1001100;
4d5:a1=7b0100100;
4d6:a1=7b0100000;
4d7:a1=7b0001111;
4d8:a1=7b0000000;
4d9:a1=7b0000100;
default: a1=7bx;
endcase
end
always @(B0)
begin
case(B0)
4d0:b0=7b0000001;
4d1:b0=7b1001111;
4d2:b0=7b0010010;
4d3:b0=7b0000110;
4d4:b0=7b1001100;
4d5:b0=7b0100100;
4d6:b0=7b0100000;
4d7:b0=7b0001111;
4d8:b0=7b0000000;
4d9:b0=7b0000100;
default: b0=7bx;
endcase
end
always @(B1)
begin
case(B1)
4d0:b1=7b0000001;
4d1:b1=7b1001111;
4d2:b1=7b0010010;
4d3:b1=7b0000110;
4d4:b1=7b1001100;
4d5:b1=7b0100100;
4d6:b1=7b0100000;
4d7:b1=7b0001111;
4d8:b1=7b0000000;
4d9:b1=7b0000100;
default: b1=7bx;
endcase
end
always @(S0)
begin
case(S0)
4d0:s0=7b0000001;
4d1:s0=7b1001111;
4d2:s0=7b0010010;
4d3:s0=7b0000110;
4d4:s0=7b1001100;
4d5:s0=7b0100100;
4d6:s0=7b0100000;
4d7:s0=7b0001111;
4d8:s0=7b0000000;
4d9:s0=7b0000100;
default: s0=7bx;
endcase
end
always @(S1)
begin
case(S1)
4d0:s1=7b0000001;
4d1:s1=7b1001111;
4d2:s1=7b0010010
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