四路抢答器设计报告1.docVIP

电 子 课 程 设 计 题 目： 抢答器电路设计 系 别： 电气与电子工程系 专 业： 自动化 姓 名： 学 号： 指导教师： 奥特曼 河南城建学院 2011年6月日 抢答电路选用优先编码器 74LS148 和锁存器 74LS297 来完成。该电路主要完成两个功能：一是分辨出选手按键的先后，并锁存优先抢答者的编号，同时译码显示电路显示编号（显示电路采用七段数字数码显示管）；二是禁止其他选手按键，其按键操作无效原理及设计：该部分主要由555定时器秒脉冲产生电路、十进制同步加减计数器74LS192减法计数电路、74LS48译码电路和个7段数码管即相关电路组成。具体电路如图所示。块74LS192实现减法计数，通过译码电路74LS48显示到数码管上，其时钟信号由时钟产生电路提供。按键弹起后，计数器开始减法计数工作，并将时间显示在七段数码显示管上，当有人抢答时，停止计数并显示此时的倒计时时间；如果没有人抢答，且倒计时时间到时， 输出低电平到时序控制电路，同时以后选手抢答无效。结合我们的实际经验及考虑到元器件的成本，我们选择的电阻值为R1=15K，R2=68K，C=10uF，代入到上式中即得 ，即秒脉冲。 设计电路如图所示。电路选用优先编码器 74LS148 和锁存器 74LS