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2015统计表 一、数字逻辑设计： 组合逻辑电路分析题9% 组合逻辑电路设计题8% 时序电路器件原理理解12% D触发器、J-K触发器等13% 时序：二进制计数器分析与设计13% 时序：移位寄存器分析与设计10% 时序：移位寄存型计数器分析与设计12% 时序电路分析与设计中重点步骤：状态图、波形图16% 这些都太简单，我只有直接回复订阅号告诉你们了！2% 听课目标 只要考试能过就行啊 查漏补缺有所提高26% 我可是为了刷到满绩来的73% 提升学科能力才是最重要的（文献查找、实验设计） 学习学科的前沿知识 学习步骤 考试重点-题型与主要内容 题型：填空、选择题、分析题、设计题。 内容主要：期中考试以后学习的内容，占 70-80%以上。另外如数选、二进制译码器及以前部分内容可能会在大题中使用。 考试重点-组合部分 1、三态器件、异或门、校验电路和比较器 2、加法器、累加器和组合乘法器 3、数据选择器、二进制译码器 4、卡诺图化简 5、BCD码等基本知识的应用 考试重点-时序部分---第7章 1、锁存器结构与性能 2、D触发器结构性能及相关电路 3、有限状态机表达和分析 计数器、序列信号发生器 序列信号检测器 状态分析、转移列表设计、系统分解设计 4、同步状态机的概念 考试重点-时序部分----第8章 二进制计数器的规模化设计 二进制计数器的典型应用 移位寄存器结构和典型应用 移位寄存器型计数器的应用 一、组合电路重点知识回顾 进制转换（10,2,8,16） 补码系统（概念、运算） 编码（8421BCD,2421BCD,余3码，格雷码） 关于函数的基本概念 表达一个函数的方法 典型芯片的运用（二进制译码器、显示译码器、数据选择器、优先编码器、全加器、比较器、奇偶校验电路） NOTES: bit（位） 1 byte(1个字节)=8bits MEMORY:256M=256M Bytes 1KB=1024 Bytes 1MB=1024*1024 Bytes 1GB=1024*1024*1024 Bytes 进制转换（10,2,8,16） What is the range of representable number,if you have n-bit binary number ? 0~2n-1 十进制转二进制 整数部分的转换：除以2取余,倒着数。 小数部分的转换：乘2取整,正着数。 八进制转二进制 十六进制转二进制 Sum up for the Complement (总结) 1.Positive number has the same： Sign-Magnitude, Ones’ – Complement, and Two’s- Complement ( 正数的原码、反码、补码相同) 2. MSB (the sign bit) : 1 =minus; 0=plus Weight of the MSB: -2n-1 2.6 Two’s – Complement Addition  and Subtraction (二进制补码的加法和减法) we define [x] to be the two’s complement representation of x [x + y] = ( [x] + [y] ) [x - y] = ( [x] + [-y] ) 2.6.3 the rule for detecting overflow  （溢出的判断规则）(P41) 1.对于二进制补码，加数的符号相同，和的符号与加数的符号不同,则有溢出. 2.最高数值位产生的进位与符号位产生的进位不同则有溢出. 3.扩展符号位后运算，判断运行结果中两个符号位是否相同,不同则有溢出. BCD(8421)码 2421 码 余 3 码 (excess-3) 二五混合码(biqunary code) (an error-detecting property 具有检错特性) 10中取1码（1-out-of-10 code） 格雷码 Duality and Complement (对偶和反演) (P194.P195) 4.1.6 Standard Representations of Logic Functions (P196) Truth table 真值表 product term 乘积项