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VHDL1 第1章 数字系统硬件设计概述 第1章 数字系统硬件设计概述 1.VHDL程序举例 VHDL的英文全名是Very－High－Speed Integrated Circuit Hardware Description Language，诞生于1982年。1987年底，VHDL被IEEE(The Institute of Electrical and Electronics Engineers) 和美国国防部确认为标准硬件描述语言。 Verilog HDL在1995年被IEEE确认为标准描述语言。 从功能上讲，两者是相通的，只是在语法上有些区别。掌握了VHDL语言，理解Verilog HDL语言也不会十分费力。 基于VHDL的自顶向下设计方法 数据选择器： 在数字系统中，经常要把多个通道的信号传递到公共数据线上，因此，需要在地址码（选择控制信号）的控制下，从若干路输入数据中选择一路做为输出，完成这一逻辑功能的电路叫数据选择器，又叫多路选择器、多路开关。其框图如下： 例: 2选1数据选择器的设计 图为—个2选1的多路选择器逻辑图，a和b分别是两个数据输入端的端口名，s为通道选择控制信号输人端的端口名，y为输出端的端口名。其逻辑功能可表述为： 若s=0,则 y=a;