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二、JK触发器 1.定义 0 0 0 0 0 0 1 1 1 0 0 1 1 0 1 1 0 1 0 0 0 1 1 0 1 1 0 1 1 1 1 0 三、T触发器 1. 定义：凡在时钟信号作用下，具有如下功能的触发器 0 0 0 0 1 1 1 0 1 1 1 0 四、D触发器 1. 定义：凡在时钟信号作用下，具有如下功能的触发器 0 0 0 0 1 0 1 0 1 1 1 1 逻辑功能： 是 与输入及 在CLK作用后稳态之间的关系 （RS, JK, D, T） 电路结构形式： 具有不同的动作特点（转换状态的动态过程） （同步，主从，边沿） 集成D触发器 1 2 3 4 5 6 7 8 RD1 D1 CP1 SD1 Q1 Q1 地 +VCC RD2 D2 CP2 SD2 Q2 Q2 74??74 14 13 12 11 10 9 8 1 2 3 4 5 6 7 1 2 3 4 5 6 7 8 R Q1 Q1 D1 D2 Q2 Q2 地 +VCC Q4 Q4 D4 D3 Q3 Q3 CP 74??175 16 15 14 13 12 11 10 9 1 2 3 4 5 6 7 8 集成 负边沿J—K触发器 Q Q J K CP RD SD 74LS73/双下降沿J—K触发器 74LS109/双上升沿J—K触发器 1 2 3 4 5 6 7 8 CP1 RD1 K1 +VCC CP2 RD2 J2 J1 Q1 Q1 地 K2 Q2 Q2 74??73 14 13 12 11 10 9 8 1 2 3 4 5 6 7 D触发器应用 分析下面组合电路的逻辑功能。 1 R +5V Q4 Q3 Q2 Q1 D4 D3 D2 D1 S4 S3 S2 S1 Q4 Q3 Q2 Q1 R CP D 74LS175 四人抢答器 I6I5I4I3I2I1I0 5V 二进制编码器 带数字显示的七路抢答器 0 1 0 0 0 1 1 1 0 0 0 1 1 1 0 0 0 0 0 1 1 1 1 1 0 0 1 0 T触发器应用 CP T0 Q0 T1 Q1 “1” “1” CP Q0n+1 Q1n+1 分频器 ① ② ③ ④ ⑤ 二、主从JK触发器 1. 电路结构与工作原理 (b) 国标符号 (a) 电路图 主从RS触发器特性表 X X X X 0 0 0 0 0 0 1 1 1 0 0 1 1 0 1 1 0 1 0 0 0 1 1 0 1 1 0 1 1 1 1 0 X X X X 0 0 0 0 0 0 1 1 1 0 0 1 1 0 1 1 0 1 0 0 0 1 1 0 1 1 0 1* 1 1 1 1* 主从JK触发器特性表 2. 主从JK触发器的特点： 2. 主从JK触发器 消除了不确定状态，在CLK=1期间， J和K可以同时为1。 1. 功能最全：置1，置0，保持，翻转； 3. 主从结构克服了空翻，但是主触发器存在一次性翻转。即在CLK=1期间若J和K发生变化，则可以根据JK触发器的功能判断主触发器的状态，一旦由J和K的变化引起主触发器状态翻转一次
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