第11章时序逻辑电路试卷.pptVIP

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*;*;R-S触发器真值表;R-S触发器真值表;;;R-S触发器真值表;R-S 触发器特点:;*;*;*;*;*;*;*;*;*;*;*;*;*;*;*;*;*;*;集成4D触发器74LS175的应用举例—抢答电路;课堂练习;;课堂练习(续);*;*;*;*;分析步骤图示:;*;*;*;*;Q2;同步、特殊Moore型电路;(1)求激励方程和输出方程:;31;(4)画状态转移图:;(5)逻辑功能分析:;什么是可自启动电路?;;*;11.3.1寄存器;由4D集成电路74LS175 组成4位二进制数寄存器;数码寄存器(续);数码寄存器用于计算机 并行输入/输出接口;2 串行移位寄存器;循环移位寄存器;13.6 寄存器;11.3.2计数器;二进制数;4位二进制表示的最大数为: 1111B=8+4+2+1=15D=;4位二进制加法计数器状态转换表;(1). 异步二进制加法计数器;用4个维—阻型J-K触发器组成 4位异步二进制加法计数器;4位异步二进制加法 计数器时序图;4位异步二进制加法计数器状态转换表;(2). 同步二进制加法计数器;分析??态转换表,找出控制规律:;;同步二进制加法计数器;4位同步二进制加法计数器;十进制数用0~9十个数字表示,而 数字电路中使用二进制,所以须用 二进制数给十进制数编码;CP Q3 Q2 Q1 Q0 10 1 0 1 0 11 1 0 1 1 12 1 1 0 0 13 1 1 0 1 14 1 1 1 0 15 1 1 1 1;(1)异步十进制加法计数器设计 (用下降沿触发的维—阻型J-K触发器);异步十进制加法计数器设计 (用下降沿触发的维—阻型J-K触发器);;异步十进制加法计数器 (用下降沿触发的维—阻型J-K触发器);十进制加法计数器 状态转换表;*;*;*;*;*;*;*;习题

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