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实验二组合逻辑电路的设计和测试
二、实验原理 1．组合逻辑电路 使用中、小规模集成电路来设计组 合电路是最常见的逻辑电路。设计组合电路的一般步骤如图1所示。 根据设计任务的要求建立输入、输出变量，并列出真值表。然后用逻辑代数或卡诺图化简法求出简化的逻辑表达式。并按实际选用逻辑门的类型修改逻辑表达式。 根据简化后的逻辑表达式，画出逻辑图，用标准器件构成逻辑电路。最后，用实验来验证设计的正确性。 2．组合逻辑电路设计举例 用“与非”门设计一个表决电路。当四个输入端中有三个或四个为“1”时，输出端才为“1”。设计步骤：根据题意列出真值表如表1所示，再填入卡诺图表2中。 表1 由卡诺图得出逻辑表达式，并演化成“与非”的形式 三、实验内容 1．设计用与非门（74LS00）异或门（86）、与门（08）组成的半加器电路。 要求按本文所述的设计步骤进行，直到测试电路逻辑功能符合设计要求为止。 2．设计一个一位全加器，要求用异或门、与门、或门（32）组成。 3．设计一位全加器，要求用与或非门（54）实现。74LS54引脚排列及逻辑图如图3所示。 4．设计一个对两个两位无符号的二进制数进行比较的电路；根据第一个数是否大于、等于、小于第二个数，使相应的三个输出端中的一个输出为“1”，要求用与门、与非门及或非门（02）实现。 四、实验所用集成块个数和功能 74LS00*2 个----- 2输入四与非门 02*1个----- 2输入四或非门 08*1个----- 2输入四与门 20*3个----- 4输入双与非门 32*1个----- 2输入四或门 54*2个----- 4输入与或非门 86*1个----- 2输入四异或门 * * 实验3 组合逻辑电路的 设计与测试 一、实验目的 掌握组合逻辑电路的设计与测试方法。 图1 表2 根据逻辑表达式画出用“与非门”构成的逻辑电路如图2所示 图2 图3 74LS54引脚排列。 实验1解答
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