半加器和全嫉挠器.pptVIP

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2017-05-06 发布于浙江
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半加器和全嫉挠器.ppt

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半加器和全嫉挠器

Evaluation only. Created with Aspose.Slides for .NET 3.5 Client Profile 5.2.0.0. Copyright 2004-2011 Aspose Pty Ltd.;半加器和全加器 ;实验目的;实验原理;全加器两个多位数相加是每一位都是带进位相加，所以必须用全加器。这时只要依次将低位的进位输出接到高位的输入，就可构成多位加法器了。全加器是一种由被加数、加数和来自低位的进位数三者相加的运算器。基本功能是实现二进制加法。全加器的真值表见表2。逻辑表达式： ;串行进位并行加法器目前普遍应用的全加器的集成电路是74LS283，它是由超前进位电路构成的快速进位的4位全加器电路，可实现两个四位二进制的全加。其集成芯片引脚图如图3所示。加进位输入C0和进位输出C4主要用来扩大加法器字长，作为组间行波进位之用。由于它采用超前进位方式，所以进位传送速度快，主要用于高速数字计算机、数据处理及控制系统。;用74LS283构成一位8421BCD??加法器 ;74LS283;管脚对应关系：1~7孔对应1~7脚 12~18孔对应8~14脚 8,9,10,11为空孔;数码管A为最低位，D为最高位，A~D为别对应283输出的S1~S4;实验内容与步骤 ;实验报告要求 ;思考题