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2017-06-09 发布于广东
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数字集成电路的时序分析.pdf

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31 2 V o . 31, 2 2001 4 M icroelectr onics A pr . 200 1 : 1004 -3365( 200 1) 02-0126-04 吕宗伟, 林争辉, 张　镭 ( , 2000 30) : 　文章对数字集成电路设计中的时序分析作了一个概的介绍。对一些时序分析算法进行了讨论, 同时, 指出伪路径是时序分析中的一个重问题。因此, 为了进行有效的时序分析, 必须同时考虑电路的逻辑行为和时序行为。 : 　逻辑综合; 伪路径; 数字集成电路; 时序分析; 时序验证 : 　T N431. 2 : A Timi ng Analysis of Digital Integrated Circuits - , - , L U Zong w ei L IN Zheng hui ZHA N G L ei ( LSI Research Institute, Shanghai Jiaotong University , Shanghai 200030, P. R. China) . Abstract: T he timing ana y sis in the design o f dig ita integ rat ed circuits is described So me a go rithm s for the timing ana ysis ar e discu ssed. It is po inted out that the f a se path is an impo rt ant pr ob em in the t iming ana y sis . A s a resu t , bot h the o gica behavior and the tempor a behav io r o f the netw or k mu st be taken into consideration for eff ectiv e timing ana y sis . Key words : L og ic synthesis; F a se path ; Dig ita IC; T iming ana y sis; T iming ver if icat ion EEACC: 1265 , 1　引　言 , 3 , ( data input ) ( dat a o ut put ) SPICE , ( cont ro input ) : , SPICE , , 80 , ; [ 1] , , ,