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2017-08-12 发布于上海
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基于小数分频的锁相环设计 fraction-n phase-locked loop design.pdf

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基于小数分频的锁相环设计 fraction-n phase-locked loop design

第8卷，第9期电子与封装总第65期 V01．8．No．9 EI，E(琊iONICSP：ACKAGING2008年9月一一’ 一，一、．屯+、’路，设一许j 基于小数分频的锁相环设计彭进忠1．一，王军成2，莫亭亭1，李章全1 (1．上海交通大学微电子学院，上海200240I2．中芯国际集成电路制造有限公司，上海201203) 摘要：锁相环电路广泛应用于现阶段集成电路芯片中，由于需要较高的输出频率解析度，小数分频的锁相环得到了越来越多的关注。但是小数分频调制器会引入较大的噪声，因此如何降低系统噪声、提供高性能相位噪声的锁相环成为现阶段研究的重要课题。文章给出了基于小数分频技术的锁相环设计与噪声分析，分析了各个主要模块的设计要求与优化方法。芯片在SMIC流片制造，采用了0．13|Im逻辑工艺，从样片的测试结果来看，Sigma—Delta模块的噪声得到了较好的抑制，满足了预先的设计要求。关键词：锁相环；相位噪声；压控振荡器；小数分频器中图分类号：TN75 文献标识码：A Fraction-NPhase-locked Design Loop PENG Jin-zhon91．2，WANG Jun·chen92，MOTing-rin91，LIZhang—quanl National 200240，China；2．Semiconductor (1．ShanghaiJiao扬愕university，Shanghai Manufacturing Corporation，Shanghai201203，China) Abstract：Phase—lockedis usedinSOCsolutions．Becauseofthe resolution loopwidely highoutputfrequency bemore will andmore theother medula- loop popular．Onhand,sigma-delta required，fraction-Nphase-locked torintroducenoisetothe decreasethe noise phase-lockedloop，which phase-lockedloopphase performance． This afraction-N used asthefraction·N modulator divider， paperpresent phase—lockedloop，whichsigma-delta it the noise foreach the to block,thengive methodologyimpr