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FPGA/CPLD应用技术（Verilog语言版） 第一章 认识数字系统设计开发环境： 一、填空题 1. （1）11001，19 （2）45，2D （3）111111，63 2. 建立工程；输入设计；编译工程；设计仿真；器件编程 3. Altera 4. 可编程只读存储器PROM（Programmable Read Only Memory） 可编程逻辑阵列PLA（Programmable Logic Array） 可编程阵列逻辑PAL（Programmable Array Logic） 通用阵列逻辑器件GAL（Generic Array Logic） 可擦除可编程逻辑器件EPLD（Erasable Programmable Logic Device） 复杂可编程逻辑器件CPLD（Complex Programmable Logic Device） 现场可编程门阵列FPGA（Field Programmable Gate Array） 5. 低密度可编程逻辑器件(LDPLD)、高密度可编程逻辑器件(HDPLD) 6. “与或阵列”、“门阵列”、 “与或阵列” 7. 输入电路、与阵列、或阵列、输出电路 8. 可编程功能单元、可编程I/O引脚、可编程布线资源和片内存储块RAM 9. 电子设计自动化、Electronic Design Automatic 10. 硬件描述语言、Hardware Description Language 11. Programmable Read Only Memory Programmable Logic Array可编程逻辑阵列 Programmable Array Logic可编程阵列逻辑 Generic Array Logic通用阵列逻辑器件 Erasable Programmable Logic Device可擦除可编程逻辑器件 Complex Programmable Logic Device复杂可编程逻辑器件 Field Programmable Gate Array现场可编程门阵列 Very-High-Speed Hardware Description Language 超高速硬件描述语言 In System Programming 在系统可编程 Look-Up Table 查找表 Programmable Logic Device 可编程逻辑器件 Logic Array Blocks 逻辑阵列块 Computer Aided Design 计算机辅助设计技术CAD 12. 写出下列英文单词的中文意思。 （1）工程、项目 （2）向导 （3）器件 （4）封装 （5）管脚 （6）系列 （7）原理图 （8）图表 （9）块 （10）符号 （11）输入 （12）输出 （13）编译 （14）信息 （15）分析 （16）综合 （17）装配、布局 （18）汇编、装配 （19）报告 （20）波形 （21）节点 （22）仿真器 （23）功能的 （24）时序的 （25）分配 （26）熔丝 （27）互连 （28）宏单元 （29）乘积项 （30）进位 二、问答题 1. 画出Quartus II软件的完整设计流程。 答案：如图T1.1所示。 图T1.1 Quartus II软件的完整设计流程 2. 答案：共包括以下5步：①建立工程；②输入设计；③编译工程；④设计仿真；⑤器件编程，任务实现基本流程如图T1.2所示。  图T1.2 设计步骤 3. 答案：如图T1.3 图T1.3 可编程逻辑器件的分类 4. 画出4选1数据选择器的输入输出结构及真值表。 答案：如图T1.4和表T1.1所示。 图T1.4 4选1数据选择器 表T1.1 4选1数据选择器真值表 控制选择端 输出 S1 S0 F 00 01 10 11 P0 P1 P2 P3 5. 简述FPGA的一般设计流程。 答案： FPGA/CPLD进行电路设计的过程是指在计算机上利用EDA工具软件对FPGA/CPLD器件进行开发设计的过程，一般包括设计准备、设计输入、功能仿真、设计实现、时序仿真、下载编程和器件测试七个步骤。 （1）设计准备 设计准备阶段是FPGA/CPLD进行电路设计的第一步，包括方案论证、系统设计、器件选择等工作。 （2）设计输入 设计输入阶段就是设计者将设计电路以某种方式输入到计算机中。设计输入通常有以下几种方式：原理图输入方式、HDL硬件描述语言输入方式、波形输入方式、层次设计输入方式、状态机图表输