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脉冲序列检测器的设计
测试与光电工程学院
课程设计任务书
电子科学与技术 系 班 学生
课题名称： 脉冲序列检测器的设计
课题要求：查找相关资料，确定基于FPGA的多路脉冲序列检测器的设计方案，要求能对多路脉冲序列信号进行检测。
课题内容：
1、系统设计要求：脉冲序列检测器广泛应用于现代数字通信系统中。随着通信技术的发展，对多路脉冲序列信号检测要求越来越高，本实验设计一个基于FPGA的多路脉冲序列检测器。设计完成后，经综合和仿真验证后，在FPGA中实现。
2、工作进度安排：
查找相关资料，确定脉冲序列检测器设计方案 11月15日～11月21日 第12周
系统各模块的详细设计 11月22日～12月28日 第13周
系统仿真及修正 11月29日～12月5日 第14周
系统测试，课程设计报告的撰写 12月6日～12月10日 第15周
主要参考资料：
潘松，黄继业 EDA技术使用教程（第三版） 科学出版社2006
邬杨波，王曙光，胡建平 有限状态机VHDL设计及优化信息技术 2004(01)
刘欲晓 EDA技术与VHDL技术 电子工业出版社 2009.4
鄢靖丰，陈晓黎，王平 用Verilog-HDL设计序列检测器 2005(11)
唐瑜，符兴吕，罗江 用VHDL语寿实现序列信号的产生和检测 2008(09)
蒋昊,李哲英 基于多种EDA工具的FPGA设计流程[J].微计算机信息,2007
束礼宝,宋克柱,王砚方.伪随机数发生器的FPGA实现与研究[J].电路与系统学报,2003.8
系负责人： 指导教师： 柴明钢 时间：2010年11月10日
摘要
脉冲序列检测器广泛应用于现代数字通信系统中,随着通信技术的发展，对多路脉冲序列信号检测要求越来越高。现代通信系统的发展方向是功能更强、体积更小、速度更快、功耗更低,大规模可编程逻辑器件FPGA器件的集成度高、工作速度快、编程方便、价格较低，易于实现设备的可编程设计，这些优势正好满足通信系统的这些要求。随着器件复杂程度的提高,电路逻辑图变得过于复杂,不便于设计。VHDL(VHSIC Hardware Description Language)是随着可编程逻辑器件的发展而发展起来的一种硬件描述语言。VHDL具有极强的描述能力,能支持系统行为级、寄存器输级和门级三个不同层次的设计,实现了逻辑设计师多年来梦寐以求的“硬件设计软件化”的愿望,给当今电子通信系统设计带来了革命性的变化。
本文针对传统的脉冲序列检测器方案,提出了一种基于FPGA的脉冲序列检测器设计的新方案，该方案相对于传统的设计方法更适合于现代数字通信系统,不但大大减少了周边的设备,也使系统设计更加灵活,稳定性更好,性价比更高,可以满足多种环境下的检测系统的要求。
关键词:可编程逻辑器件FPGA，硬件描述语言VHDL，序列检测器
目录
摘要..................................................3
1.绪论................................................6
1.1课题设计背景.........................................6
1.2课题设计目的.........................................6
2. FPGA简介............................................7
2.1 什么是FPGA.........................................7
2.2 FPGA的结构与组成...................................8
2.3 FPGA的设计流程.....................................9
2.4主控芯片Cyclone简介..................................15
2.5硬件描述语言VH......................................16
3 脉冲序列检测器的设计...................................18
3.1脉冲序列检测器的原理..................................18
3.2 设计要求...........................................19
3.3设计内容...........................................
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