常系数fir中的csd串并乘法器设计 design csd serial-parallel multiplier for constant coefficients fir filter.pdfVIP

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2017-08-20 发布于上海
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常系数fir中的csd串并乘法器设计 design csd serial-parallel multiplier for constant coefficients fir filter.pdf

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常系数fir中的csd串并乘法器设计 design csd serial-parallel multiplier for constant coefficients fir filter

第32卷第4期电子器件 Vol-32No．4 Chinese Of日d：臼吼Devi嘲 2009年8月 Journal Aug．2009 FIR CSDSerial-ParallelforConstantCoefficientsFilter Design Multiplier SONGXiulanl．LI Xiaojian92’ InformationEngineering，ZhejiangUniversityofTechnology，Hangzhou ／1．Collegeof 310014，China；、 k2．InstituteMicroelectronicsCAS 100029。China ， of of Beijing hasa bitmethodsaremorethanother Abstract：Canonic feature：zero SignedDigit major methodsforthesame makeitsuitableforreductionofconstantcoefficients in— digit．This multiplier．After troductionofthe ofconstantcoefficientsreduction，the of principle designprocessserial—parallelmultiplier theCSDisdetailed．Wehave this tOthe of23orderconstantcoefficients using applytechniquedesign pulse FIRfilterforIS95一WCDMA．Thecircuitareahas than resultdemonstra- shaping 42％smallerbefore，this tedthatthereductionofCDSwas efficient． very coefficients Keywords：digitalsignalprocessing；canonicsigneddigit；serial—parallelmultiplier；constant FIRfilter EEACC：6140；7220 常系数FIR中的CSD串并乘法器设计宋秀兰1，李晓江2’ ／1．浙江工业大学信息工程学院，杭州310014、／＼2．中国科学院微电子研究所，北京100029 摘要：介绍了二进制数的Canonic SignedDigit(CSD)表示的特点，0位值比其他表示方法都要多。应用这一点在常系数的