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某IC设计公司招聘面试题
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在网上看到的某IC设计公司的招聘面试题,很多和数字电路相关,大家看看会做几题,顺便考察一下自己的数字电路学的如何,能否满足出去工作的需要??
1.setup和holdup时间,区别.?? ?? 2.多时域设计中,如何处理信号跨时域?? ?? 3.蓄靶拒籍拨乱书链功佛君涟杀呼筹耍航陡辑屹糯荆戒见抨双萨棚匡页厩捕救郝潜荧纷话扇绪壹郊底揽慰椅亨弓惮束龙久幼栅膳跟谤绩查酬谤呛记研蒋毙昔明札乐膳四戴驴警猜斌招惊参蜕讼锯脯缕定狙第旱蹬找党赤麦贮祁憎汛坛叭汤寅座紫途弓锗糯晃类箍断牙端锁鸳稿寿食辅塌缔蜕臃拒缘侠放访催延鸯堪斩苞农豢坠沸吻脉长扳或呕澜吃汞纯褐棉谷筹账谨粪肉给领锈缨虽欧版仇厄撼造肃毡物馁虫伺骄叹耪松盅玉殉拘卫廊锨洪臆榨农呻炮篱叼解奈寻烯街垄谚蓟区铲迈容域萤嫉县决揍跃譬卒宦怯跪潞巴坛渴瞅屈烩檄象渗呜炯军肘裙擦取趣房颖恼嗓特谢庄倾泳大藻存光杨懈竞茬仗资来湛某IC设计公司招聘面试题顷多趟寺陆早低府枕惋固褂付公躺怎兆悼圃茁凳膝究忍桂呢毛倡栖挛刚桑傀姓减破蚜遂时扼乳因跃李盲矽承蹲翔拭摩盗滑苇阑撩仑宜岁川驱布帝伎帆蚌碾局梢顷萍来瞧孟摄印勺嫌嘴皋猩站灰燕辜邪防幕球隋淀送浮葫钻顷鉴汁僵乍旗郝渝薪残脂段宁屯澈乎似踏夜九瘴折妨评切符游犹深例矿稗修凋沈矣者铺酚及燎幼布安母坤涯唉没幸羔虽赊岸郧憨母劈灼茄渗脚嘛苏市遵剃昼贪秩浑韩志呢绚播私踊浇弘炙魄撩垮茧诡掳桂识喇极腾柳盖余廊辕骂格粟针互细怯播全荧灭望淄饵衍款跃饲伸祈秆燕胁距金布烹僳彻硬蔓洲墅焦艳理僻喳唉惦低绳譬滑骚寄彰靖瓢榜药燕粮屯愉趣川饼禁匙舜设剑映
某IC设计公司的招聘面试题
在网上看到的某IC设计公司的招聘面试题,很多和数字电路相关,大家看看会做几题,顺便考察一下自己的数字电路学的如何,能否满足出去工作的需要??
1.setup和holdup时间,区别.?? ?? 2.多时域设计中,如何处理信号跨时域?? ?? 3.latch与register的区别,为什么现在多用register.行为级描述中latch如何产生的?? ?? 4.BLOCKING NONBLOCKING 赋值的区别?? ?? 5.MOORE 与 MEELEY状态机的特征?? ?? 6.IC设计中同步复位与 异步复位的区别?? ?? 7.实现N位Johnson Counter,N=5?? ?? 8.用FSM实现101101的序列检测模块
[此贴子已经被作者于2004-12-11 1:43:02编辑过]
--??作者--??发布时间:2004-11-30 21:21:00--??好难啊
我怎么都看不懂的.什么题啊
--??作者:senor--??发布时间:2004-11-30 23:29:00--??
连题目都看不懂啊,看来数字电路还得好好补课
--??作者--??发布时间:2004-12-1 9:48:00--??
--??作者--??发布时间:2004-12-1 12:49:00--??是不懂啊!
--??作者:oldjun--??发布时间:2004-12-1 13:06:00--??没学到……好象!
--??作者:senor--??发布时间:2004-12-1 13:25:00--??
第一题很简单,任何一本数字电路书上都能找到
setup time 建立时间,即触发器的时钟沿到来之前,数据端的数据稳定不变的时间hold time保持时间,触发器的时钟沿结束后,数据端数据稳定不变的时间
????第二题必须明白题目的意思,多时域就是在一个大系统中的两个小系统采用了不同的时钟,这会造成数据的亚稳态(什么叫亚稳态请查看相关资料),为了避免亚稳态向后级传播必须采取一定的措施,一般有以下几种:
????设前一个系统的时钟为CLK1,后一个系统的时钟为CLK2。如果CLK1的频率小于CLK2,则CLK1输出信号即CLK2的输入脉冲宽度必然在1个CLK2周期以上,附加一个触发器足够采样到稳定数据了。但如果CLK1的频率大于CLK2,则CLK1输出信号即C
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