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2017-08-25 发布于上海
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2.5 gbs sdhsonet低阶支路处理器芯片设计 chip design for 2.5gbs sdhsonet low-order tributary processor

2009 年第08 期，第42 卷通信技术 Vol.42，No.08,2009 总第212 期 Communications Technology No.212,Totally 2.5 Gb/s SDH/SONET 阶支路处理器芯片设计 ① ② ③ 波 , 李天望，罗敏 (①上海电力学院计算机与信息工程学院，上海 200090;②武汉大学集成电路与通讯软件系, 湖北武汉430079; ③朗讯科技光网络有限公司, 上海 200233) 【摘要】设计了2.5 Gb/s SDH/SONET 的低阶支路处理器芯片，单片实现STS-48/STM-16 的低阶支路终结，包括低阶容器的通道监控，混合VT1.5/TU-11 和VT2/TU-12 容器的终结，V1/V2 指针解释，虚级联数据的提取，开销字节的提取和处理， BIP-2 检测，RDI/REI 在发送方向的环回，VT/TU 级的保护倒换等。采用TSMC 0.13µm CMOS 工艺流片成功，电路规模约12.6 万门。满足光纤通信传输要求,并成功用于光纤通信设备。【关键词】SDH/SONET；低阶支路; 芯片；处理器【中图分类号】TN913.7；TN492 【文献标识码】A 【文章编号】1002-0802(2009)08-0009-03 Chip Design for 2.5Gb/s SDH/SONET Low-order Tributary Processor ① ② ③ YE Bo , LI Tian-wang , LUO Min (①Faculty of Computer Information Engineering, Shanghai University of Electric Power, Shanghai 200090, China; ② Dept. of Integrated Circuit Communication Software, Wuhan University, Wuhan Hubei 430079, China; ③Lucent Technologies Optical Network Co., Ltd., Shanghai 200233, China) Abstract】A chip implementation for 2.5 Gb/s SDH/SONET low-order tributary processor is presented. The chip could implement the termination of STS-48/STM-16’s tributaries, including path monitoring of low-order containers, and the termination of mixed VT1.5 TU-11/ VT2 TU-12 containers. And these implementations also include V1/V2 pointer interpretation, extraction of virtual concatenated data, overhead-byte extraction processing, BIP-2 error detection, RDI/REI’s feedback on low