4_Quartus_II应用向的导_问题总结与解答.pptVIP

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2017-10-13 发布于湖北
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4_Quartus_II应用向的导_问题总结与解答

EDA 技术实用教程;CPLD/FPGA的VHDL设计的基本流程是什么？为什么需要建立工程，为什么建立了工程后还不能编译成功？为什么分VHDL输入和原理图输入？如何实现VHDL输入和原理图输入的切换（创建元件符号）？如何区分RTL原理图和工程原理图输入？发现错误要如何解决？为什么要经常进行全程编译？引脚列表是什么？为什么要进行引脚连接？为什么要使用嵌入式逻辑分析仪？嵌入式逻辑分析仪是什么？它的使用步骤如何？;时序仿真;设计输入 VHDL输入和原理图输入;为什么需要建立工程，为什么建立了工程后还不能编译成功？;4.1 基本设计流程 ;4.1 基本设计流程 ;4.1 基本设计流程 ;4.1 基本设计流程 ;;2. 频率计主结构电路设计 ;如何实现VHDL输入和原理图输入的切换（创建元件符号）？;图4-42 元件输入对话框 ;图4-43 将所需元件全部调入原理图编辑窗并连接好 ;图4-44 连接好的全??器原理图f_adder.bdf ;如何区分RTL原理图和工程原理图输入？;设计库已有需要设计者设计;发现错误要如何解决？;为什么要经常进行全程编译？;引脚列表是什么？为什么要进行引脚连接？;拨码输入 SW1A: PIN_R22 SW2A: PIN_T22 SW3A: PIN_U21 SW4A: PIN_U22;图4-22 GW48实验系统模式5实验电路图 ;图4-23 Assignment Editor编辑器 ;图4-24 两种引脚锁定对话框 ;为什么要使用嵌入式逻辑分析仪？;嵌入式逻辑分析仪是什么？它的使用步骤如何？;图4-36 SignalTap?II编辑窗 ;图4-37 SignalTap II编辑窗 ;图4-38 设定SignalTap?II与工程一同综合适配 ;图4-39 下载cnt10.sof并准备启动SignalTap?II ;图4-40 SignalTap?II采样已被启动 ;多操作，勤练习，善思考！