第3篇TMS320F2812中断系统.pdfVIP

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2017-09-06 发布于北京
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第3篇TMS320F2812中断系统.pdf

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北京化工大学BUCT 信息科学与技术学院本科课程教学 EEE32501T DSP原理与应用 Principles and Applications of DSP 通信0901-0904信工0901-0903 主讲教师韩阳 : Michael 2012-4-11 VERSION EEE32501T200901-0304 COPYRIGHT© 2009EECEMIC 2012.2.13 ALL RIGHTS RESERVED. 第3章 TMS320F2812中断系统第3章 TMS320F2812中断系统中断是CPU对系统发生的某个事件作出一种反应， CPU暂时终止正在执行的程序，保留现场后自动转去执行相应事件的处理程序，处理完成后返回断点，继续执行被打断的原程序，中断请求信号是由硬件或软件驱动的信号。 2 第3章 TMS320F2812中断系统第3章 TMS320F2812中断系统中断系统是系统输入/输出部分中非常重要的一个部分，通常需要由软硬件构成的中断系统模块对系统中的多个中断源进行管理和控制。其中硬件部分主要负责接收中断源发出的各种中断请求，并按照某种方式响应其请求，然后将系统控制权交给特定的中断服务程序；软件部分主要负责识别中断源的类型并按其类型处理特定的中断请求。 3 3.1 TMS320F2812中断的基本原理与结构 TMS320F2812的中断管理分为三级：外设级中断管理 PIE(Peripheral Interrupt Expansion, PIE, 外设中断扩展)级中断管理 CPU级中断管理 4 3.1 TMS320F2812中断的基本原理与结构 TMS320F2812支持32个CPU级中断源，并支持软件和硬件两种中断。软件中断：由INTR、ORIFR或TRAP指令激发。硬件中断：外部中断—— 由外部中断引脚上的信号触发。内部中断—— 由片内外设的信号触发。 5 3.1 TMS320F2812中断的基本原理与结构 TMS320F2812外设级中断管理主要负责外设内部的中断源的屏蔽与使能。 PIE级中断管理主要负责将各种已使能的外设中断进行分组管理并形成最终的CPU中断请求。 CPU级中断管理主要负责处理直接向CPU申请的中断请求，这些中断请求分别来自PIE外设中断模块、外部中断引脚和片内32位的CPU定时器。操作顺序: 首先由某个事件引起外设产生中断请求并传送到PIE模块。 6 外设(SPI,SCI,McBSP,CAN,EV,ADC) (41个中断源)