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H264ABT与量化器的硬件设计与实现
第25卷第9期 机 电 工 程 V01．25No．9
2008年9月 MECHANICAL＆ELECTRICALENGINEERINGMAGAZINE Sep．2008
H．264
ABT与量化器的硬件设计与实现。
胡 琛，张宇弘
(浙江大学超大规模集成电路研究所，浙江杭州310027)
摘
4×4整数DCT与量化算法。利用两种变换算法可合并性和量化的相似性，设计了可复用ABT和量化
0．18斗m
器的硬件电路，并使用Verilog语言对该设计进行了超大规模集成电路(VLSI)实现，采用SMIC
工艺，综合后的电路关键路径最大延时为11．94ns，电路面积为1．20mm2。实验对比结果表明，本设计
IDCT与量化，增
在基本不增加面积的情况下，使得原来只能处理8×8的IDCT和量化器也能处理4×4
强了硬件电路的适应性，同时也提高了系统的灵活性。
关键词：超大规模集成电路；H．264；自适应块划分尺寸变换；整数DCT；量化
中图分类号：TP331．1 文献标识码：A
Hardwareand ofH．264ABTand
designimplementation quantizator
HUChen．ZHANG
Yu．hong
VLSI
(Instituteof Design，Zhefiang 310027，Chian)
University，Hangzhou
onthe of block of8×8 DCTand
Abstract：Based transforms(ABT)andalgorism integral quantizationimple·
conceptadaptive
of4×4 DCTand were the ABTand
mentation，thealgorism integral quantizationimplementationimproved，andmultiplex quanti·
zatorwere becauseofthe oftwo was HDL and U·
designed algorisms．ItprototypedusingVeriloglanguageimplemented
similarity
SMIC0．1 ofcriticalis11．94asafter theareaofthe is1．20mm‘．
sing 8肛mtechnology．Thelength path synthesis，and system
tothe data．thecircuitmakesthecommonIDCTand for8×8blockscanalso the4×
experimental quantizator process
According
4blockswithlittlein
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