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- 2018-03-01 发布于浙江
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[信息与通信]锁相环频率合成器的设计
锁相环频率合成器的应用
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n 的应用范围很广,在通信中应用的一些
,用于从(可能带有噪声的)有用信号里
提取时钟信号。在这样的应用中,抑制噪声很
重要。
n 而 的频率综合是一个完全不同的应用,此
时,不关心参考噪声,但是综合器应用能够快
速地从一个频率跳变到另一个频率,因此,最
相关的是捕获时间。
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n 因此,要给每个 系统一个优化结果的设计
过程很困难,但可以根 一个设计流程来进行
设计过程。
n 这个设计流程不是适用于所有 的普遍工
具,但至少可以算作一系列设计提示,而且,
在大多数设计过程中, 的设计是一个迭代
的过程,可以从一些初始的假设入手,但可能
以最后的设计结果不能接受为结束,因为可能
一个或多个参数超出了计划范围,此时可以改
变前提条件重复这个流程,直到满足要求。
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n 集成电路的生产商已经提供了在 机上可
以运行的设计工具,如 发布的一个程序
可以用来设计采用流行的集成电路
等系列的 系统。
n 以下即为设计流程:
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n 规定 的输入和输出频率,输入和输出频率
可能都是常数,或者一个或两个是变量,可以
设为 和 , 和 。
1min 1max 2min 2max
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n 确定分频比,在一些应用中,输出频率 总是
2
等于输入频率 ,此时分频比为 。当用于
1
频率综合器时,可定义其取值范围
(min max )。
n 自然频率和阻尼因子理论上都是随 的变化而
变化的,为简化设计,可取 mean为
N N N
mean min max
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n 反馈支路包括一个 分频器的锁相环的相位传
输函数为:
s K K F s N
H s 2 0 d
s s K K F s N
1 0 d
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n 自然频率和阻尼因子理论上都是随 的变
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