官方说明书摩托罗拉 MPC2104P MPC2105P 说明书.pdfVIP

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官方说明书摩托罗拉 MPC2104P MPC2105P 说明书.pdf

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官方说明书摩托罗拉 MPC2104P MPC2105P 说明书

MOTOROLA MPC2104P MPC2105P Manual /file/2687977 From ManualL ManualL collects and classifies the global product instrunction manuals to help users access anytime and anywhere, helping users make better use of products. Home: / Chinese: / This Manual: /file/2687977 查询MPC2104P供应商 Order this document SEMICONDUCTOR TECHNICAL DATA by MPC2104P/D MPC2104P Product Preview MPC2105P 256KB/512KB BurstRAM Secondary Cache Modules for PowerPC PReP/CHRP Platforms The MPC2104P (256KB) and MPC2105P (512KB) are designed to provide burstable, high performance L2 cache for the PowerPC 60x microprocessor family in conformance with the PowerPC Reference Platform (PReP) and the PowerPC Common Hardware Reference Platform (CHRP) specifications. The MPC2104P and MPC2105P utilize synchronous BurstRAMs. The MPC2104P module is configured as 32K x 64 bits and uses two of the 3.3 V 32K x 32 data RAMs. The MPC2105P is configured as 64K x 64 bits and uses two of the 3.3 V 64K x 32 data RAMs. Both modules are in a 178 (89 x 2) pin DIMM format. For tag bits on the 2104P, a 5 V cache tag RAM configured as 8K x 14 for tag field plus 8K x 2 for valid and dirty status bits is used. For tag bits on the 2105P, a 5 V cache tag RA