数字电子技术知识项目二逻辑门电路.pptxVIP

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  • 2018-05-30 发布于天津
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数字电子技术知识项目二逻辑门电路.pptx

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数控系统机床结构数字电子技术主讲人:编码合逻辑电路脉冲信号的产生与整形数制和码制时序逻辑电路逻辑门电路数模和模数转换器集成触发器大规模数字集成器件及应用目 录项目导读通过对楼梯灯控制电路的应用设计,熟悉开关器件的特性;学习二极管门电路及组合逻辑门电路,掌握几种通用的集成逻辑门电路以及它们的逻辑功能和特性;并学会利用逻辑门电路惊醒电路的分析和设计。任务2.1 分立元器件门电路任务2.2 TTL集成逻辑门电路任务2.3 CMOS集成逻辑门电路任务2.4 TTL与CMOS接口电路逻辑门电路02任务浏览能力目标让学生通过对实际的楼梯灯控制电路的直观认识和应用,学习逻辑表达式的应用、逻辑表达式的相互转换,并练习用集成电路来实现该功能。任务2.1 分立元器件门电路2.1.1 晶体管开关特性1.二极管开关特性由于二极管具有单向导电性,因此可以当作外加电压控制的开关使用。二极管的伏安特性曲线如图2.1所示。二极管开关电路及等效电路如图2.2所示。图2.1二极管的伏安特性曲线图2.2 二极管开关电路及等效电路任务2.1 分立元器件门电路2.1.1 晶体管开关特性3.MOS管开关特性(1)截止条件UGSN(th)为NMOS的开启电压,UGSN(th)=2 V,当uGSUGSN(th)时,NMOS管截止,漏源极之间可等效为一个电阻ROFF,称为关断电阻,阻值为108~109Ω。漏极电流iD≈0 A,输出uo=UOH=VDD。NMOS管相当于开关断开,其等效电路如图2.5(b)所示。(2)导通条件当uGSUGSN(th)时,NMOS管导通,漏源极之间可等效为一个电阻RON,称为导通电阻,阻值约为几百欧姆;当RDRON时,输出uo= ≈0 V。NMOS管相当于开关闭合(有导通电阻),其等效电路如图2.5(c)所示。由于期间内部、线间和负载电容的存在,电流和电压的变化都需要时间,因此输出电压的变化将滞后于输入电压的变化。图2.5NMOS开关电路及等效电路任务2.1 分立元器件门电路2.1.2 二极管门电路实现“与”逻辑关系的电路称为与门电路。而由二极管组成的与门电路称为二极管与门电路。(1)二极管与门电路的电路图 二极管与门电路的电路结构和逻辑符号分别如图2.6(a)和2.6(b)所示。 其中:A、B为信号的输入端,Y为信号的输出端。(2)工作原理实现“或”逻辑关系的电路称为或门电路。而由二极管组成的或门电路称为二极管或门电路。(1)二极管或门电路的电路图二极管或门电路的电路结构和逻辑符号分别如图2.7(a)和2.7(b)所示。 其中,A、B为信号的输入端,Y为信号的输出端。(2)工作原理1.二极管与门电路2.二极管或门电路任务2.1 分立元器件门电路2.1.3 组合逻辑门电路1.与非门在与门后面接一个非门就构成了与非门。与非门的真值表见表2.1。从真值表可看出,与非门的逻辑功能是:“全1出0,有0出1”。逻辑函数式:其逻辑符号如图2.8所示。任务2.1 分立元器件门电路2.1.3 组合逻辑门电路2.或非门在或门后面接一个非门,就构成或非门。或非门的真值表见表2.2。从真值表可看出,或非门的逻辑功能是:“全0出1,有1出0”。逻辑函数式:Y=A+B.其逻辑符号如图2.9所示。任务2.1 分立元器件门电路2.1.3 组合逻辑门电路3.与或非门把两个或两个以上的与门的输出端接到一个或门的各个输入端,便构成了一个与或门;其后再接一个非门,就构成了与或非门。与或非门的真值表见表2.3。从真值表可看出,与或非门的逻辑功能是:当输入端中任何一组全为“1”时,输出即为“0”;只有各组输入都至少有一个为“0”时,输出才能为“1”。逻辑函数式:其逻辑符号如图2.10所示。任务2.1 分立元器件门电路2.1.3 组合逻辑门电路4.异或门异或门是只有两个输入变量的逻辑门。异或运算的逻辑关系是:当两个输入信号相同时,输出为“0”;当两个输入信号不同时,输出为“1”。异或门的真值表见表2.4。从真值表可看出,异或门的逻辑功能是:当两个输入端的状态相同(都为“0”或都为“1”)时,输出为“0”;反之,当两个输入端状态不同(一个为“0”,另一个为“1”)时,输出端为“1”。逻辑函数式:其逻辑符号如图2.11所示。任务2.1 分立元器件门电路2.1.3 组合逻辑门电路5.同或门同或门同样只有两个输入变量。同或运算的逻辑关系是:当两个输入信号相同时,输出为“1”;而当两个输入信号不同时,输出为“0”。同或门的真值表见表2.5。从真值表可看出,同或门的逻辑功能是:当两个输入端的状态相同(都为“0”或都为“1”)时输出为“1”;反之,当两个输入端状态不同(一个为“0”,另一个为“1”)时,输出端为“0”。逻辑函数式:其逻辑符号如图2.12所示。任务2.2 TTL集成逻辑

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