EDA课程设计--用VHDL语言实现数字钟的设计.docxVIP

用VHDL语言实现数字钟的设计 2011年12月21日一、EDA课程设计的目的与任务（一）、掌握利用可编程逻辑器件和EDA设计工具进行电子系统设计的方法，内容包括：（1）VHDL程序设计、输入——在ise平台上用VHDL描述系统的功能（2）逻辑综合——将源程序编译后，为设计系统选择一个电路实现方案，按照这个方案进行逻辑综合和优化，生成1个电路网表文件（3）功能仿真——检查自己的设计是否达到和完成要求的逻辑功能（4）设计实现——布局、布线及配置，最后生成可以写到芯片中的目标文件（5）时序仿真——是适配到选定的芯片后进行的仿真，它模拟芯片的实际动作，仿真时间模型严格将门级延时计算在内，可以分析出竞争与冒险，时序仿真验证过的电路与实际电路基本上已致。（6）器件编程——对器件编程下载（7）测试二、EDA课程设计的要求设计实现一个具有带预置数的数字钟，具有显示年月日时分秒的功能。用6个数码管显示时分秒，set按钮产生第一个脉冲时，显示切换年月日，第2个脉冲到来时可预置年份，第3个脉冲到来时可预置月份，依次第4、5、6、7个脉冲到来时分别可预置日期、时、分、秒，第 8个脉冲到来后预置结束，正常工作，显示的是时分秒。Up为高电平时，upclk有脉冲到达时，预置位加1.否则减1，还可以在此基础上增加其它功能。用VHDL语言实现数字钟的设计摘要随着IT行业的不断发展EDA技术在很多