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用于FPGA和处理器新型多路输出稳压器 　　基于现代高性能处理器和FPGA的系统需要越来越多的专用电源轨来为内核、I/O、存储器和精密模拟电路供电。当今典型的处理器系统通常使用独立开关稳压器和LD0供电，但随着电路板面积越来越小，设计更高效率电源管理系统变得日益困难。将多个开关稳压器和LDO合并到单个封装中，可以实现超小型、灵活、高效率电源管理解决方案，为微处理器/FPGA和精密模拟器件供电，且系统可靠性最高。这种新型全集成式多路输出稳压器为FPGA和处理器系统的电源设计人员带来四大好处。 　　解决方案尺寸 　　将多个开关降压稳压器、LDO、电源监控器和看门狗功能集成到单芯片解决方案中，可以大幅缩小多轨电源解决方案的PCB面积。ADP5034就是一个很好的范例，它是一款集成2个300mA LDO的双通道1.2A降压稳压器，采用24引脚LFCSP封装。 　　ADP5034在单个封装中集成多个开关稳压器和LDO，实现新一代高集成度多路输出稳压器，只需非常小的电路板空间。集成开关稳压器以3MHz开关频率工作，允许使用非常小的片式电感。当两个开关稳压器同时使能并以PWM模式工作时，二者配置为异相运行，以便降低所需输入电容的大小和成本，进一步缩小外部元件的尺寸，同时将所产生的电磁干扰（EMI）降至最低。 　　图2显示分立与集成两种解决方案的对比：左图是由2个1.2A降压稳压器和2个300m ALDO组成的示例布局，右图是单芯片ADP5034多路输出稳压器。分立电源解决方案需要将22个器件贴装在97mm2PCB面积上，而ADP5034解决方案只需将I9个器件贴装在72mm2PCB面积上。ADP5034解决方案所需的PCB面积减少35%，并且节省了贴装3个器件的成本。 　　易于使用 　　新产品的设计周期越来越短，初始阶段易于设计、未来又能根据设计要求轻松修改的新型电源解决方案对于保证新产品发布日期日益重要。ADP504l多路输出稳压器提供1个1.2A降压稳压器和2个300mA LDO，并集成上电复位功能和看门狗定时器以支持基于高可靠性处理器的系统。ADP5041的所有集成稳压器都有专用使能引脚，为电源设计工程师提供极大的灵活性，可以通过硬件使能或禁用各稳压器，无须任何软件工作，并且可以轻松控制3个电源轨的上电时序。各稳压??的输出电压利用外部电阻分压器设置，电源设计工程师同样可以利用这一点来轻松快捷地更改输出电压，从而满足原型开发和需要不同输出电压组合的新设计。多路输出稳压器的各集成稳压器都有独立的使能引脚和电阻可编程的输出电压，有助于降低电源设计的复杂度，缩短设计时间，加快新产品上市。ADIuPMU内置针对各种输入/输出电压和输出电容的补偿功能，此外还集成软启动和保护电路（UVLO、TSD、过流等）。所有这些特性极大地减少了工程师的设计和故障排除时间。每种器件的引脚排列都考虑到了简化电路板布局和器件贴放的需求，无源器件可以尽可能靠近各稳压器放置，使布线距离最短，这对于尽量降低电路板寄生效应和噪声非常重要。对电源电路设计知之甚少甚至一无所知的工程师再也无须害怕使用复杂的多路输出稳压器，只需按照数据手册布线和元件选择指南操作即可。 　　系统可靠性更高 　　与基于分立稳压器的设计相比，多路输出单芯片稳压器设计所需的器件数量更少，因而PCB上需要贴放和检查的器件更少，制造成本更低，制造可靠性更高。将电源监控器和看门狗定时器与多个稳压器集成为单芯片解决方案，可以实现更高的系统可靠性。ADP5041多路输出稳压器集成了一个高精度上电复位电路，它可以监控ADP5041的输入电压或任一输出电压轨。在基于处理器的典型系统中，上电复位电路（电源监控器）用来确保内核电压轨处于正确的电平，然后才会让处理器离开复位状态。随着新型处理器和FPGA的内核电压轨越来越低，高精度上电复位电路变得更加重要。ADP5041提供外部电阻可编程的上电复位，整个温度范围内的精度为±1.5%。利用这种集成式高精度上电复位电路，可以精准可靠地监控最新一代处理器、ASIC和FPGA的低压内核电源轨，从而提高最终产品的可靠性。该上电复位电路的电阻可编程能力还意味着，新设计可以轻松快捷地设置给定内核电压的跳变阀值电压。 　　利用集成的看门狗定时器可以监控微处理器代码执行活动，保证处理器安全可靠地工作。看门狗定输入引脚（WDI）上的每次低到高或高到低逻辑跃迁都会使定时器电路清零，它能检测最短50ns的脉冲。如果定时器在预设的看门狗超时期间（tWD）计时，复位就会置位。微处理器需要使WDI引脚发生跳变以避免复位。因此，如果在超时时间内微处理器未能使WDI跳变，则说明发生代码执行错误，由此产生的复位脉冲将重新启动微处理器并使其进入已知状态。 　　除了WDI上的逻辑跃迁外，VCC欠压或/MR变为