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PAGE 39 时序电路（计数器、移位寄存器） 一、实验目的1．掌握常用时序电路分析，设计及测试方法。2．训练独立进行实验的技能。二、实验仪器及材料1．实验仪器设备：双踪示波器、数字万用表、数字电路实验箱2．器件 74LS112 双J-K触发器 2片 74LS175 四D触发器 1片 74LS10 三输入端三与非门 1片 74LS00 二输入端四与非门 1片 注：CLK——CP， PR ——SD， CLR——RD 三、实验内容及步骤1．异步二进制计数器 （1）按图6-1接线。将J=K=1图6-1由CP端输入单脉冲，测试并记录Q1～Q4端状态及波形。 输出波形图CP端与Q1端波形图CP端与Q2端波形图CP端与Q3端波形图CP端与Q4端波形图 输出状态表输出Q4Q3Q2Q1状态由上往下顺序变化，循环0000000100100011010001010110011110001001101010111100110111101111（3）试将异步二进制加法计数改为减法计数，参考加法计数器，要求实验并记录。4个JK触发器都是在需要翻转时就有下降沿，不需要翻转时没有下降沿，所以4个触发器都应接成T’型 电路图： 输出波形图CP端与Q1端波形图CP端与Q2端波形图CP端与Q3端波形图CP端与Q4端波形图 2．异步二-十进制加法计数器 （1）按图6-2接线。 QA、QB、QC、QD 四个输出端分别接发光二极管显示，复位端R接入单脉冲，置位端S接高电平“1”，CP端接连续脉冲。 图6-2（2）在CP端接连续脉冲，观察QA、QB、QC、QD相对于CP的波形。 CP端与QA端波形图CP端与QB端波形图CP端与QC端波形图CP端与QD端波形图 （3）将上图改成一个异步二-十进制减法计数器，并画出QA、QB、QC、QD和C相对于CP的波形。B1JB1J C11K1J C11KCP1J C11K1J C11K≥11FF0FF1FF2FF3Q0Q2Q1Q3Q0Q2Q1Q3 输出波形图CP端与QA端波形图CP端与QB端波形图CP端与QC端波形图CP端与QD端波形图CP端与C端波形图 图6-2四、实验总结本次实验学习了时序电路的设计与测试，主要测试了加法、减法计数器。在实验中，可以发现，时序电路的逻辑功能特点有：电路任何时刻的稳态输出不仅与该时刻的输入信号有关，而且还取决于电路原来的状态（具有记忆功能）。时序电路的结构特点有：由存储单元和组合电路构成，一定包含触发器；存储电路的状态反馈到组合电路的输入端，与外部的输入信号共同决定组合电路的输出。 分析时序电路的步骤如下： 设计时序电路的步骤如下：
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