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简易数字信号传输性能分析仪设计xfxs9qih
简易数字信号传输性能分析仪设计
2011年全国大学生电子设计竞赛
简易数字信号传输性能分析仪(E题)
【本科组】
2011年9月6日
摘要:本设计通过线性移位寄存器发生器产生m序列的数字信号和伪随机信号,数据率误差绝对值均≤1%,其中数字信号发生器采用了曼斯特编码,时钟数据率在10~100kbps内以10kbps步进可调,伪随机信号数据率为10Mbps。两路信号的时钟,均由飓风II序列的FPGA产生。低通滤波器由无限增益多路反馈二阶低通滤波电路实现。两路信号由高速运放AD811进行信号叠加后输入示波器,显示数字信号的信号眼图。数字信号分析仪所采用的时钟信号,通过开关切换,可使用数字信号发生器的时钟信号,也可以使用FPGA及其外围电路提取的同步时钟信号。
关键词:数字信号发生器、伪随机信号发生器、低通滤波器、时钟提取、眼图
Abstract: The design uses hurricane II sequence of FPGA and produce data rates of 10 to 100 kbps stepping adjustable digital signal of the clock signal and the data rate for 10 Mbps pseudo random signal the clock signal. This can produce illegal random signal’s clock signal .The clock signal’s data rate is 10Mbps. At same time that can produce two way signal’s m array through register that is linear and can move “position”. In this design, we simulate transmission information channel with low-pass filter , then apply super-speed Operational Amplifier AD811 to plus two signal. The sum of two signal input Oscilloscope, meanwhile input synchronizated clock signal which pick up from superposed signal by FPGA and its peripheral .Then we can observe eye pattern’s character. At last we can analyze digital signal’s transmission property.
Keyword: Digital Signal Generator; Illegal Random Signal Generator; Low-pass Filter; Clock Extraction; Eye Pattern
目 录
1系统方案 1
1.1数字信号发生器模块的论证与选择 1
1.2伪随机信号发生器模块的论证与选择 1
1.3低通滤波器模块的论证与选择 2
1.4同步时钟信号提取电路模块的论证与选择 3
2系统理论分析与计算 3
2.1低通滤波器的分析 3
2.1.1带外衰减的计算 3
2.1.2截止频率的计算 4
2.1.3通带增益的计算 4
2.2 m序列数字信号产生的原理分析 4
2.2.1 m序列发生器 4
2.2.2线性反馈移位寄存器 4
2.3曼彻斯特编码的介绍 5
2.4 同步时钟提取原理 6
2.5 眼图的显示方法 6
3电路与程序设计 8
3.1电路的设计 8
3.1.1系统总体框图 8
3.1.2 数字信号发生电路子系统框图与电路原理图 8
3.1.3 伪随机信号发生器子系统电路原理图 9
3.1.4 低通滤波器子系统电路原理图 10
3.1.5 同步时钟信号提取电路子系统框图与电路原理图 10
3.1.6 电源电路 10
3.2程序的设计 11
3.2.1程序功能描述与设计思路 11
3.2.2键盘控制数据率及显示程序流程图 11
4测试方案与测试结果 12
4.1 测试条件与仪器 12
4.2 测试结果及分析 12
4.2.1测试结果数据 12
4.2.2测试分析与结论 13
5 总结 14
参考文献 15
附录1:电路原理图 16
附录2:源程序 17
简易数字信号传输性能分析仪(E题)
【本科组】
1系统方案
本系统主要由数字信号发生器模块、伪随机信
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