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allegro入门学习笔记介绍 1，开原理图文件，产生网络表 打开原理图界面，orcad capture cis,如下图： 然后进行如下操作打开原理图文件（后缀名为.dsn） 开了原理图之后的界面： 然后产生网络表（netlist）,方法如下： 选中.dsn文件，tools-create netlist: 出现如下界面，直接保持默认选项，点击确定： 然后出现如下窗口，点击确定： 然后出现如下窗口，再继续确定： 这时候会在原理图文件所在的路径里产生一个名为allegro的文件夹，我们需要的网络表就存放在这个文件夹里。 此时我们已经成功产生了网络表。 2，打开PCB editor,导入网络表。 打开绘图软件，如下图： 我用的是cadence 16.2 ,其他版本的功能界面也类似。 新建一个PCB文件，后缀为.brd 将其命名为test.brd 选择board,并在上方写好命名并选好保存路径： 此时，名为test.brd的PCB文件已经新建好了。 然后导入网络表，操作如下：file-import-logic: 出现如下界面，按照红色标记的选中，下面的import directory,选择刚刚产生的网络表的路径，也就是刚刚产生的allegro文件夹路径： 设置好了之后，点击右上角的import cadence: 然后出现下面的提示，import