手动计分控制电路年耀贞张悦.docxVIP

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手动计分控制电路年耀贞张悦.docx

手动记分控制电路 组合逻辑课程设计 学院自动化工程学院 作者 2807304026年耀贞 2807304027 张 悦 摘要:该手动计分控制电路要实现的是,将按键输入十进制数0?9经 过转化,变为可以进行逻辑运算和处理的二进制数,即BCD码,这 样就可以利用七段显示译码器译码后显示输入的数字。 一、设计思路及分析 手动输入键盘上的十个键对应0-9十个数,按下的键所对应的输 入为1,未按下的输入为0,这样就得到19?10编码序列,经过编码器 编码后可得对应BCD码,然后通过七段译码器,点亮对应的二极管, 即在显示器上显示出输入的十进制数。 在整个设计过程中,可以直接利用编码器扩展再连接七段显示译 码器来实现电路功能,也可以利用Verilog语言进行编程和仿真。 二、设计方案 1?利用编码器扩展和七段译码器 1)根据设计思路得到真值表 2)用MAX+plusII软件画出电路图 A3▲OABOBCOCD A3 ▲ OA B OB C OC D OD LTN OE RBK OF QJ OG ?- Owl VW RBON BCDTO7SEG 7448 ~I f U c d ;严「_I A 利用编码器74148进行扩展,然后用门电路连接七段译码器 7448,输入19-10对应程序中的H[9]?H[0],编码之后为A3-A0,与7448 的A-D对应连接,输出连接显示器。 2.七段译码器 Verilog软件程序仿真 module vr7seg(ENz SEGA,SEGB,SEGC,SEGD,SEGE,SEGF,SEGG); input [9:0] H; input EN; output SEGAr SEGBfSEGCfSEGD# SEGE# SEGFfSEGG; reg SEGA,SEGBZSEGC,SEGD,SEGE,SEGF,SEGG; reg [1:7] SEGS; wire 3Z CfD; assign D=H[S] || H[9]; assign C=H[4] || H[5] 1 1 H[6]; assign 3=H[2] || H[3] 1 1 H[6] 1 1 H[7]; assign A=H[1] || H[3] 1 1 H[5] 1 1 H[7] || H[9]; always @ (A or B or C or D or EN) begin if (EN==0) case ({Dr C, A}) // Segment patterns abcdefg 0: SEGS = 1111110; //o 1: SEGS = 7*0110000; //I 2: SEGS = 1101101; //2 3: SEGS = 7^1111001; //3 4: SEGS = 7b0110011; //4 5: SEGS = 7bl011011; //5 6: SEGS = 7bOOlllll; //6 7: SEGS = b 1110000; //7 8: SEGS = Vblllllll; //8 9: SEGS = TblllOOll; //9 default . SEGS = 7bx; endcase else SEGS = 7?b0; {SEGA,SEGB,SEGCr SEGD,SEGEr SEGFr SEGG} = SEGS; end endiriodule 程序中的H为H[i],i=0?9的集合,其中十个按键分别为H[i],i=0?9, 且H[i]代表1。当按下第i个键时,H[i]=l,其余为0。七段显输入 DCBA为二进制表示的一个十进制数:i=Dx23+Cx22+Bx21+Ax2°. Verilog仿真图 如上图所示,H1-H9与SEGA-SEGG序列——对应,EN=0时 实现手动控制数字显示。 3)七段数字显示器及发光段组合图 afbec a f b e c d ■ DP g f COM a b e d COM c DP 0 iE 3半 18,=i (b) 七段数字显不器及发卷段组合 (a)数字显示器(b)虚示曲数字 三、总结及心得 1.通过本次课题设计,自学了一些相关的Verilog语言和 MAX+plusII软件的使用方法。 2?该手动计分控制电路主要涉及到BCD码的原理,编码器扩展,七 段显示原理以及七段显示译码器,并且利用门电路进行芯片的连接。 3.可以利用该电路及其设计思路来实现一些简单的功能,即输入并 显示对应十进制数的操作,也可以作为复杂电路的屮间环节。

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