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EDA应用课程设计 学时:1-3周 学期:第6学期 本课程设计的地位、目的和任务 本课程设计是在学生完成《数字电路与逻辑设计》、《可编程逻辑器件及应用》等课程和实验后,为加强和培养学生综合应用所学知识去解决实际问题的能力而开设的。 其目的是使学生掌握现代电子系统设计方法,培养学生的创新精神和综合应用所学专业知识解决实际电子设计问题的能力。 本课程主要任务是: (1)培养学生掌握综合运用学过的数字电路的基本知识和VHDL硬件描述语言,利用可编程逻辑器件,独立设计比较复杂的数字电路能力。 (2)培养学生对于电子系统开发的整体构思能力,体会其设计步骤、设计方法与技巧,学习编写设计开发文档,并在团队分工协作中锻炼互助协作精神。 基本要求 以实际工程应用为核心要求选题,综合设计建立在硬件和软件两个平台的基础上。硬件平台是EDA实验箱,根据不同题目设计的电路下载到一片可编程逻辑器件上,实验结果可在实验箱上实现。软件平台是ALTERA公司的Quatus II,输入方式为图形输入或文本输入。 通过课程设计,学生要掌握使用EDA工具,设计和实现现代电子系统的方法,包括设计输入、编译、软件仿真、下载和硬件仿真等全过程。具体要求如下: (1)了解可编程器件的原理、应用领域和基本的设计方法,重点学习ALTERA公司的cycloneIII系列的结构、特点和性能。 (2)了解集成开发软件Quatus II的使用及设计过程,熟悉数字电路设计方法,掌握图形设计方法和VHDL硬件描述语言设计方法。 (3)、熟悉EDA实验箱的使用,根据给定题目设计数字电路,来加深对可编程逻辑器件的理解和掌握。 安排 课程设计内容:不固定(老师根据实验箱情况给备选题目,或学生自己找题目,设计可行行方案,老师检查) 时间分配:总学时16学时;要求学生1-3周内完成设计,每周有2学时的答疑时间。 课程设计期间的组织工作由主讲教师全面负责,每班除主讲教师外,还可 配备一位辅导教师。教师在指导过程中要求: 提供必要的参考资料; 要求与学生一起进行方案论证,帮助学生确定最后的设计方案; 及时掌握学生的设计进度,及时答疑、督促检查; 引导学生发挥主观能动性,鼓励创新; 学生按小组进行,每组3~5人,选组长一人,负责组内实习分工。组员在组长的统一安排下,分工协作,共同完成课程设计任务。 设计报告 A、按设计指导书中要求的格式书写,所有内容一律打印; B、报告内容包括设计过程、软件仿真的结果及分析、硬件仿真结果及分析; C、报告中要有整体电路原理图、各模块原理图以及程序代码; D、软件仿真包括各个模块的仿真和整体电路的仿真; E、硬件仿真要标出各个信号的连接脚和输出信号的测试结果。 考核办法 总成绩 = 报告成绩20% + 作品成绩70% + 答辩成绩10%(或回答问题); 其中:报告成绩,由指导教师评阅判定;作品成绩,由检查教师根据作品完成情况评定;----答辩成绩,由答辩教师根据答辩情况评定;答辩不通过者,最终成绩评定为不及格。最终成绩按等级划分:优秀(90分以上)、良好(80-89分)、中等(70-79分)、及格(60-69分)、不及格(60分以下)。 答疑安排通知 。 第一周:查找资料,确定题目,确定方案 第二周:方案可行行论证(找老师答疑确定),方案实施,分工进度; 第三周:作品完成,完善,报告书完成; 第四周(6周):答辩 参考题目 设计一 数字式竞赛抢答器 设计一个可容纳6组(或4组)参赛的数字式抢答器,每组设一个按钮,供抢答使用。 抢答器具有第一信号鉴别和锁存功能,使除第一抢答者外的按钮不起作用。 设置一个主持人“复位”按钮。 主持人复位后,开始抢答,第一信号鉴别锁存电路得到信号后,有指示灯显示抢答组别,扬声器发出2~3秒的音响。 设置一个计分电路,每组开始预置100分,由主持人记分,答对一次加10分,答错一次减10分 教学提示: 此设计问题的关键是准确判断出第一抢答者并将其锁存,实现的方法可使用触发器或锁存器,在得到第一信号后将输入封锁,使其它组的抢答信号无效。 形成第一抢答信号后,用编码、译码及数码显示电路显示第一抢答者的组别,用第一抢答信号推动扬声器发出音响。 计分电路采用十进制加/减计数器、数码管显示,由于每次都是加/减10分,所以个位始终为零,只要十位、百位进行加/减运算即可。 设计二 数字钟 设计一个能显示1/10秒、秒、分、时的12小时数字钟。 熟练掌握各种计数器的使用。 能用计数器构成十进制、六十进制、十二进制等所需进制的计数器。 能用低位的进位输出构成高位的计数脉冲 教学提示: 1、时钟源使用频率为0.1Hz的连续脉冲。 2、设置两个按钮,一个供“开始”及“停止”用,一个供系统“复位”用。 3、时钟显示使用数码管显示。 4、“时显示”部分应注意12

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