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- 2019-06-09 发布于浙江
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计算机组成原理期末典型例题
1.CPU结构如图1所示,其中有一个累加寄存器AC,一个状态条件寄存器,各部分之间的连线表示数据通路,箭头表示信息传送方向。
标明图中四个寄存器的名称。
简述指令从主存取到控制器的数据通路。
简述数据在运算器和主存之间进行存 / 取访问的数据通路。
图1
解:
a为数据缓冲寄存器 DR ,b为指令寄存器 IR ,c为主存地址寄存器,d为程序计数器PC。
主存 M →缓冲寄存器 DR →指令寄存器 IR →操作控制器。
存贮器读 :M →缓冲寄存器DR →ALU →AC
存贮器写 :AC →缓冲寄存器DR →M
2. 某机器中,配有一个ROM芯片,地址空间0000H—3FFFH。现在再用几个16K×8的芯片构成一个32K×8的RAM区域,使其地址空间为8000H—FFFFH。假设此RAM芯片有/CS和/WE信号控制端。CPU地址总线为A15—A0,数据总线为D7—D0,控制信号为R//W,MREQ(存储器请求),当且仅当MREQ和R//W同时有效时,CPU才能对有存储器进行读(或写)。
满足已知条件的存储器,画出地址码方案。
画出此CPU与上述ROM芯片和RAM芯片的连接图。
解:存储器地址空间分布如图1所示,分三组,每组16K×8位。
由此可得存储器方案要点如下:
用两片16K*8 RAM芯片
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