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Intel 现代CPU 结构与技术 东南大学计算机学院 任国林 Email:renguolin@seu.edu.cn 讲座内容: ◇分布式动态调度CPU基本结构图： 转上页 回下页 加法器 乘/除法器 A1 A2 A3 保留站 M1 M2 译码器 站号 0110 … 0010 0001 取指部件 BIU(←→Cache或主存) 站号 1010 1011 1100 站号 1000 1001 站号 源1值 站号 源2值 控制 站号 源1值 站号 源2值 控制 地址 控制 取数缓冲器FLB 控制 忙位 站号 地址 数据 存数缓冲器SDB 指令队列 公共数据总线CDB F7 … F0 忙位 站号 数据 寄存器FLR FLR总线 取数部件 取数部件 注：采用分布式保留站便于减少保留站-ALU的延迟 回33页 回34页 *指令数据关系→部件关系的实现— 数据产生部件(RS/FLB)：标有站号(指示数据所在位置)， 数据接收/存储部件(RS/SDB/FLR)：设有站号项及忙位. 注：站号项—指示所接收数据的对应数据产生部件 忙 位—=1时，数据项无效(尚未接收[前趋指令未完成]) =0时，数据项可用(