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课程设计 EDA 与 VHDL 语言 课程设计报告 班 级： 电信 XX-1 姓 名： XXX 学 号： XXXXXXXX 指导教师： XX 成 绩： 电子与信息工程学院 信息与通信工程系 摘 要 此设计是以现场可编程逻辑器件 (FPGA) 为设计载体 , 以硬件描述语言 (VHDL) 为 主，以原理图输入设计为辅