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3.7 信号传输延迟与功耗 器件单元中的电容； 信号传递—状态变化：充放电导致的延迟时间 负载电容的影响、对片内大负载的缓冲设计； 电路功耗的基本概念 3.7 信号传输延迟与功耗 MOS器件的动态特性 晶体管每个极都表现出对地电容; 为简化分析,本课程只考虑栅极电容,忽略其余电容. 3.7 信号传输延迟与功耗 片内设计基本单元的输入电容 C 2 C 3 C 3 输入电容为一个输入端连接的栅极电容总和；采用最小晶 体管栅极电容为单位，晶体管面积增加时，电容增加； 3.7 信号传输延迟与功耗 逻辑单元的延迟时间 当电路状态发生变化时, 相应的电容会发生充电或 放电,充放电过程导致状 态变化（信号传递）出现 延迟。 有缘学习更多+谓ygd3076或关注桃报：奉献教育（店铺） 3.7 信号传输延迟与功耗 电路节点的延迟时间 电路的每一个节点由一个特定单元进行驱 动; 该节点可能连接到几个单元的输入端,节 点电容为这些单元输入电容之和; 节点延迟时 间: T I C O max 3.7 信号传输延迟与功耗 片内设计基本单元的时间延迟 INV NAND2 NOR2 T 2 T 3 T 3 当片内单元驱动能力一致，信号通过逻辑单元级联时，路 径时间延迟可以表现为各单元时间延迟的总和； 可以采用最小晶体管栅极电容导致的时间延迟为单位;也 可以采用标准门延迟作为单位。 3.7 信号传输延迟与功耗 若信号传递路径出现分支，计算信号传递路径的延迟 时,不仅需要考虑所经过单元的延迟,还需要考虑路径上外 挂单元的电容带来的延迟。 3.7 信号传输延迟与功耗 当线路负载过多时，加入反相器进行树状缓冲设 计，可以有效分散线路负载，缩短线路延迟时间。 T 3 65 185 T 32 82 834 47 有缘学习更多+谓ygd3076或关注桃报：奉献教育（店铺） 3.7 信号传输延迟与功耗 逻辑单元的功耗 通过导通电阻的电流会产生功耗（热耗散）； 功耗的构成： 静态功耗：CMOS电路基本可以忽略 动态功耗：状态变化过程中产生 脉冲电流功耗 充放电电流功耗 P C V2 f CC 有缘学习更多+谓ygd3076或关注桃报：奉献教育（店铺） 3.7 信号传输延迟与功耗 逻辑单元的并行设计 通过并行设计，可以减少发生状态变化的单元 数量,缩短路径延迟时间,降低功耗.