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智力竞赛抢答器逻辑电路设计 一、抢答器的简要 智力竞赛是一种生动活泼的教育形式和方法，通过抢答和必答两种方 式能引起参赛者和观众的极大兴趣，并且能在极短的时间内，使人们增加一些科 学知识和生活知识。 实际进行智力竞赛时，一般分为若干组，各组对主持人提出的问题，分必答 和抢答两种。必答有时间限制，到时要告警，回答问题正确与否，由主持人判别 加分还是减分，成绩评定结果要用电子装置显示。抢答时，要判定哪组优先，并 予以指示和鸣叫。 二、抢答器的任务与要求 设计要求：每组设置一个抢答器按钮，供抢答者使用。电路具有第一抢答信号鉴 别和锁存功能。在主持人将系统复位并发出抢答指令后，若抢答者按动抢答开关，则该 组指示灯亮并组别鉴别显示电路显示抢答者的组别，同时扬声器发出“嘀-嘟”的双响， 音响持续2-3S。电路具备自锁功能，使别组的抢答器开关不起作用。 设计任务：本题的根本任务是准确判别第一抢答者的信号并将其锁存。实现这功能 可用触发器或锁存器等。在得到第一信号后应该将其电路的输出封锁，使其他组的抢答 信号无效。同时还必须注意，第一抢答信号必须在主持人发出抢答命令后才有效，否则 应视为提前抢答而犯规。当电路形成第一抢答信号之后，LED显示组电路显示其组别。 还可鉴别出的第一抢答信号控制一个具有两种工作频率交换变化的音频振荡器工作，使 其推动扬声器发出响音，表示该题抢答有效。 三、设计方案 用TTL或CMOS集成电路设计智力竞赛抢答器逻辑控制电路，具体要求如下： 1. 抢答组数为4组，输入抢答信号的控制电路应由无抖动开关来实现。 2. 判别选组电路。能迅速、准确地判处抢答者，同时能排除其它组的干扰 信号，闭锁其它各路输入使其它组再按开关时失去作用，并能对抢中者有光、声 显示和呜叫指示。 3. 计数、显示电路。每组有三位十进制计分显示电路，能进行加/减计分。 4. 定时及音响。 必答时，启动定时灯亮，以示开始，当时间到要发出单音调“嘟”声，并熄 灭指示灯。 抢答时，当抢答开始后，指示灯应闪亮。当有某组抢答时，指示灯灭，最先 抢答一组的灯亮，并发出音响。也可以驱动组别数字显示（用数码管显示）。回 答问题的时间应可调整，分别为 10s、20s、50s、60s 或稍长些。 4、主持人应有复位按钮。抢答和必答定时应有手动控制。 抢答器电路原理框图结构 图 3.1 抢答器原理框图结构框图 利用锁存型 D 触发器 CD4042 来完成的四路抢答器。如图 3-4 所示，触发器 CD4042 电源 电 与非门 CD4012 等元器件组成抢答器的控制电路，Q1-Q4,LED1~LED4 等元器件组成显示 控 电路，与非门 CD4011 等元器件组成声音提示电路， SA1~SA4 组成抢答按钮，S5A 复位 显示电路 抢 答 开 按钮，触发器CD4042 是电路的核心元件。当6 脚输出高电平时，触发器CD4042 的输出 制 状态由输入的时钟脉冲的的高的电平来决定，CP=O 时锁存数据，CP=1 时传输数据。 主持人开 电 声音提示电路 三、各单元电路设计 路 （1）控制电路的设计 门控多谐振荡电路 控制电路是由锁存型的 D 触发器 CD4042 和与 非门 CD4012 等组成（如图3－8）； CD4042 含有四 组具有共同单位控制储存指挥输入 .控制极性是可 以选择的。如POL 输入为低电平电位及 STORE 输入亦为低电平,送至 D 输入之数据将在 其个别真的及互补