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数字电子钟逻辑电路设计 摘要 本次数字时钟电路设计使用了三片 74LS161 二进制计数器 ,三片 74LS160十进制计数器和一片74LSOO二输入四与非门采用异步连接设计构成数字电 子钟。分、秒均使用 60 进制循环计数，时使用 24 进制循环计数。 关键词 电子时钟；清零；循环计时 1 设计任务及主要技术指标和要求 1.1 设计任务： 用中小规模集成电路设计一台能显示时，分，秒的数字电子钟。 1.2 主要技术指标和要求： 1.2.1 由 555 定时器产生 1Hz 的标准秒信号。 1.2.2 秒、分为 00~59 进制计数器 1.2.3 时为 00~23 二十四进制计数器。 2