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图像处理系统中 SDRAM 控制器的 FPGA 实现 The Implementation of SDRAM Controller Based on FPGA in a Digital Image Processing System (1. 中国科学院长春光学精密机械与物理研究所 ;2. 中国科学 院研究生院 ) 庞双德 1,2，刘艳滢 1 PANG Shuang-de LIU Yan-ying 摘要： 简要介绍了 SDRAM工作原理并认真研究了 Altera 提供的 SDRAM控制器， 根据实际系统使 用需要加以修改简化，设计了对修改后控制器进行操作的状态机。采用全页突发读写模式， 每次读 / 写后自动刷新，省掉了传统设计中的刷新计数控制逻辑。整个设计采用 VHDL实现， 已在实际系统中成功使用。 关键词： SDRAM控制器； FPGA； 状态机； 高速缓存 + 中图分类号 : TP274 .2 文献标识码： A Abstract: Principles of SDRAMare introduced in this paper. After careful studying of the SDRAM Controller issued by Altera, the article modified and simplified it and designed a FSMto control it for the sake of the practical use. Fullburst read/write mode is adopted and the SDRAMis refreshed at the end of each read/write operation which omits the refreshing logic in traditional design. The design is implemented with VHDL and has been successfully used in our digital image system. Keywords: SDRAM Controller; FPGA; finite state machine; cache 1、引言 在实时视频图像处理系统中，由于要对视频图像进行实时处理，而视频数据流的数据 量大，实时性要求高，所以需要高速大容量的存储器作为图像数据的缓存。 SDRAM （ ，同步动态随机存取存储器）相比于 SRAM（Static RAM ，静 Synchronous Dynamic RAM 态随机存取存储器）等存储器具有容量大、速度快、体积小、价格低等优点，因此成为图像 处理系统中常用的数据存储器。但 SDRAM的控制逻辑比较复杂，对时序要求也十分严格，所 以需要设计专门的 SDRAM控制器以完成和 SDRAM芯片的接口。本文在对 Altera 提供的 SDRAM控 制器 IP核适当修改的基础上实现了对图 1的图像处理系统中 SDRAM的有效控制。 FPGA ADV7123 数字视频输入 模拟视频输出 SDRAM 图１ 在以上系统中， Camera Link 接口的相机送出的高速 LVDS视频信号经 Channel Link 接 收芯片 DS90CR288接收转化为 TTL 电平后送给 FPGA，再由通过 FPGA实现的 SDRAM控制器将 有效像素数据写入 SDRAM。另外，通