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QUARTUSII9.1软件的使用。；
实验流程：
1120页到131页的操作指南；
2、将124页的程序，输入到QUARTUSII9.1的文本编辑环境中去；
〔注意：程序第11行
signal qout :interger range 0 to 16;应改为
signal qout :std_logic_vector(3 downto 0 );
程序第21行
elseif(qout =1001)then应改为
elsif(qout =1001)then
3、验证最后仿真的得到的波形图是否和图5-31 时序仿真的波形图是否一致；
功能仿真设置：
时序仿真设置：
4、根据三-八译码器真值表完成VHDL程序的设计并仿真。
输入
输出
D2
D1
D0
Q7
Q6
Q5
Q4
Q3
Q2
Q1
Q0
0
0
0
0
0
0
0
0
0
0
1
0
0
1
0
0
0
0
0
0
1
0
0
1
0
0
0
0
0
0
1
0
0
0
1
1
0
0
0
0
1
0
0
0
1
0
0
0
0
0
1
0
0
0
0
1
0
1
0
0
1
0
0
0
0
0
1
1
0
0
1
0
0
0
0
0
0
1
1
1
1
0
0
0
0
0
0
0
表 SEQ 表 \* ARABIC 1 3-8译码器真值表
三-八译码器功能仿真考前须知：
因为需要考察电路输入的所有状态，因此需要输入分别有000、001、010、011、100、101、110、111d
界面旁边的赋值选项此时高亮显示表示可用，选中C，在弹出的对话框中进行设置。
波形输入按钮
波形输入按钮
7段译码器的说明：
在实验1中使用了一个7段译码器，其由7个发光二极管构成，二极管的负极接到对应引脚，正极接高电平构成共阳极的7段数码管。
如下如所示:显示0时，a,b,c,d,e,f管脚接低电平，g管脚接高电平点亮的二极管会显示数字0 。如下图：
实验结果：
下面分别是功能仿真和时序仿真的结果
3-8译码器
主程序：
library ieee;
use ieee.std_logic_1164.all;
entity couunt10 is
port(en:in in std_logic
a:in std_logic_vector(2 downto 0);
q:out bit_vector(7 downto 0));
end entity count10;
architecture beha of count10 is
signal sina_in:std_logic_vector(2 downto 0);
signal sina_out:std_logic_vector(7 downto 0);
begin
sina_in=a
process(sina_in,en)
begin
if(en=’0’) then
case sina_in is
when “000〞=sina_out=;
when “001〞=sina_out=;
when “010〞=sina_out=;
when “011〞=sina_out=;
when “100〞=sina_out=;
when “101〞=sina_out=;
when “110〞=sina_out=;
when “111〞=sina_out=;
when others=sina_out=;
end case
else
sian_out=〞ZZZZZZZZ〞;
end if;
q=sian_out
end process;
end beha;
3-8译码器仿真结果：
功能仿真
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