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- 2023-05-05 发布于四川
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本发明揭示了一种基于UVM的多进程之间的进程控制方法及装置,所述方法包括:S1,每一个组件在设置的结束仿真时间内若持续没有采样到对应输出总线的输出信号之后,进入待结束状态;S2,确认其余各个组件是否均已进入了待结束状态,若其余组件未进入,则进入S3,若进入,则进入S4;S3,当前组件继续采样输出信号,若采样到,则进入S1,若未采样到则进入S2;S4,当所有组件均进入了待结束状态后,延迟一段配置的延迟时间,仿真测试结束。本发明增加了多个进程之间的协调控制作用,从而保证仿真平台在合适的时间点停止采样
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 114296900 A
(43)申请公布日 2022.04.08
(21)申请号 202111645268.7
(22)申请日 2021.12.29
(71)申请人 苏州盛科通信股份有限公司
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