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用于集成电路的减性图案化的互连结构.pdfVIP

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  • 2023-05-28 发布于四川
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用于集成电路的减性图案化的互连结构.pdf

    IC互连结构包括减性图案化的特征。特征端可通过多个盖材料的多图案化而被定义，以获得减小的未配准。减性图案化的特征可以是与镶嵌过孔或者与减性图案化的过孔相集成的线路，或者可以是与镶嵌线路或者与减性图案化的线路相集成的过孔。减性图案化的过孔可作为平面金属层的部分被沉积并且当前随互连线路被定义。减性图案化的特征可与空气间隙隔离结构相集成。减性图案化的特征可包括底部、顶部或侧壁上的阻挡材料。减性图案化的特征的底部阻挡可采用区域选择性技术而被沉积，以便不存在于下层互连特征。减性图案化的特征的阻挡可包括特征

    (19)国家知识产权局 (12)发明专利申请 (10)申请公布号 CN 116171493 A (43)申请公布日 2023.05.26 (21)申请号 202180067654.4 M ·V ·梅茨　M ·雷肖特科　

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