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西安电子科技大学网教数字逻辑电路模拟试题 西安电子科技大学网教数字逻辑电路模拟试题 PAGE/NUMPAGESPAGE/NUMPAGES 西安电子科技大学网教数字逻辑电路模拟试题 v1.0可编写可更正 模拟试题一 一、单项选择题（每题2分，共30分） 1、以下数中最大的数是[]。 A（）HB（）D CODB 2、（）D的余3BCD是[]。 B CD 3、与非门的输出完成F=,则节余输入端[]。 A全部接高电平B只要一个接高电平即可 C全部接地电平D只要一个接地即可 4、逻辑函数F=＋B的最小项标准式为[]。 AF=BF= CF=DF= 5、与AB＋AC＋相等的表达式为[]。 ACBC＋CDA+ 6、函数F=(A＋C)(B＋)的反函数是[]。 1 v1.0可编写可更正 AG=(＋B)·＋·BG=A＋C＋B· CG=(A＋)·C＋B·DG=(A)·＋(B+) 7、逻辑函数的逻辑相邻项是[]。 AACBACBDDABC 8、已知输入A、B和输出F的波形以下列图， 其F与AB的逻辑关系为[]。 A与非B或非 C异或D同或 9、以下逻辑部件属于时序电路的是[]。 A译码器B触发器C全加器D移位寄存器 10、数据选择器的功能是[]。 A将一路输入送至多路输出B将输入二进制代码变换为特定信息输出C从多路输入选择一路输出D考虑低位进位的加法 11、逻辑函数用卡诺图化简时，八个逻辑相邻项合并可消去[]。 A一个变量B二个变量C三个变量D四个变量 12、JK触发器从01,则激励端J、K的取值为[]。 2 v1.0可编写可更正 AJK=1XBJK=X0CJK=X1DJK=0X 13、移位寄存器的现态为0110，经过左移一位后，其次态为[]。 A0110或1011B1011或1010C0110或1110D1101或1100 14、4级触发器组成计数器，组成13进制计数器，其无效的状态数为[]。 A3个B4个C13个D16个 15、N级触发器组成环形计数器，其进位模为[]。 ANB2N CD 二、填空题（每题2分，共10分） 格雷码的特色是________________。 2.F==________________。 偶数个1相异或，其结果为________________。 4.数字电路的输出仅与当前输入相关，而与电经过去状态没关，该电路称为________________。 5.100KHZ输入信号输出频率20KHZ为该电路的分频系数为______________。 三、化简题（每题10分，共20分） 1.将函数F(ABCD)=,拘束条件AB+AC=0， 2.作出卡诺图，并在卡诺图上化简; 3 v1.0可编写可更正 3. 写出最简与或非式 ; 4. 画出逻辑图。 5. 将函数F(ABC)= BC＋BCD＋AC+AD+ 化简为最简的与非式。 四、 解析题（每题10分，共 20分） 1、译码器电路如图。 ①写出输出F的方程 ②列出真值表 ③说明功能 2.电路以下列图，分别作出(a)(b)图的状态迁移关系并说明其功能 4 v1.0可编写可更正 (a)(b) 五、设计题（每题10分，共20分） 1.用门电路设计二位二进制数的平方电路，输入二进制数B2B1,输出四位二进制数F3F2F1F0 列出真值表 写出方程 画出电路 2、用JK触发器设计一个三进制加法计数器 作出状态变换表 求出状态方程，确定激励函数 附74LS161,74LS194的功能表 74LS161功能表 输入输出 5 v1.0可编写可更正 CP Cr LD P T D C B A QD QC QB QA X 0 X X X X X X X 0 0 0 0 1 0 X X D C B A D C B A X 1 1 0 X X X X X 保持 X 1 1 X 0 X X X X 保持（进位位OC=0 ） 1 1 1 1 X X X X 计数 74LS194功能表 输入 输 出 Cr S1 S0 CP SR SL D0 D1 D2 D3 Q0 Q1 Q2 Q3 0 X X X X X X X X X 0 0 0 0 1 X X X X X X X X X 保持 1 0 0 X X X X X X X 保持 1 0 1 A X X X X X A Q0 Q1 Q2 1 1 0 X B X X X X Q1 Q2 Q3 B 1 1 1 X X D0 D1 D2 D3 D0 D1 D2 D3 模拟试题二 一、单项选择题（每题2分，共30分） 1、以下各数中与十进制数100不相等的数是（） A（64）16B.（144）8 6 v1.0可编写可更正 C.（1100100）2D.（000101000100）余3BCD 2、八进制数（30）8的8421BCD是（） 0 3、为使或非门输出为1则输入（） A.